mbed official / mbed

The official Mbed 2 C/C++ SDK provides the software platform and libraries to build your applications.

Dependents:   hello SerialTestv11 SerialTestv12 Sierpinski ... more

mbed 2

This is the mbed 2 library. If you'd like to learn about Mbed OS please see the mbed-os docs.

TARGET_TY51822R3/core_caFunc.h@138:093f2bd7b9eb, 2017-03-14 (annotated)

Committer:
<>
Date:
Tue Mar 14 16:20:51 2017 +0000
Revision:
138:093f2bd7b9eb
Parent:
130:d75b3fe1f5cb 
Release 138 of the mbed library



Ports for Upcoming Targets





Fixes and Changes



3716: fix for issue #3715: correction in startup files for ARM and IAR, alignment of system_stm32f429xx.c files https://github.com/ARMmbed/mbed-os/pull/3716

3741: STM32 remove warning in hal_tick_32b.c file https://github.com/ARMmbed/mbed-os/pull/3741

3780: STM32L4 : Fix GPIO G port compatibility https://github.com/ARMmbed/mbed-os/pull/3780

3831: NCS36510: SPISLAVE enabled (Conflict resolved) https://github.com/ARMmbed/mbed-os/pull/3831

3836: Allow to redefine nRF's PSTORAGE_NUM_OF_PAGES outside of the mbed-os https://github.com/ARMmbed/mbed-os/pull/3836

3840: STM32: gpio SPEED - always set High Speed by default https://github.com/ARMmbed/mbed-os/pull/3840

3844: STM32 GPIO: Typo correction. Update comment (GPIO_IP_WITHOUT_BRR) https://github.com/ARMmbed/mbed-os/pull/3844

3850: STM32: change spi error to debug warning https://github.com/ARMmbed/mbed-os/pull/3850

3860: Define GPIO_IP_WITHOUT_BRR for xDot platform https://github.com/ARMmbed/mbed-os/pull/3860

3880: DISCO_F469NI: allow the use of CAN2 instance when CAN1 is not activated https://github.com/ARMmbed/mbed-os/pull/3880

3795: Fix pwm period calc https://github.com/ARMmbed/mbed-os/pull/3795

3828: STM32 CAN API: correct format and type https://github.com/ARMmbed/mbed-os/pull/3828

3842: TARGET_NRF: corrected spi_init() to properly handle re-initialization https://github.com/ARMmbed/mbed-os/pull/3842

3843: STM32L476xG: set APB2 clock to 80MHz (instead of 40MHz) https://github.com/ARMmbed/mbed-os/pull/3843

3879: NUCLEO_F446ZE: Add missing AnalogIn pins on PF_3, PF_5 and PF_10. https://github.com/ARMmbed/mbed-os/pull/3879

3902: Fix heap and stack size for NUCLEO_F746ZG https://github.com/ARMmbed/mbed-os/pull/3902

3829: can_write(): return error code when no tx mailboxes are available https://github.com/ARMmbed/mbed-os/pull/3829

Who changed what in which revision?

UserRevisionLine numberNew contents of line
Kojto 113:f141b2784e32 1 /**************************************************************************//**
Kojto 113:f141b2784e32 2 * @file core_caFunc.h
Kojto 113:f141b2784e32 3 * @brief CMSIS Cortex-A Core Function Access Header File
Kojto 113:f141b2784e32 4 * @version V3.10
Kojto 113:f141b2784e32 5 * @date 30 Oct 2013
Kojto 113:f141b2784e32 6 *
Kojto 113:f141b2784e32 7 * @note
Kojto 113:f141b2784e32 8 *
Kojto 113:f141b2784e32 9 ******************************************************************************/
Kojto 113:f141b2784e32 10 /* Copyright (c) 2009 - 2013 ARM LIMITED
Kojto 113:f141b2784e32 11
Kojto 113:f141b2784e32 12 All rights reserved.
Kojto 113:f141b2784e32 13 Redistribution and use in source and binary forms, with or without
Kojto 113:f141b2784e32 14 modification, are permitted provided that the following conditions are met:
Kojto 113:f141b2784e32 15 - Redistributions of source code must retain the above copyright
Kojto 113:f141b2784e32 16 notice, this list of conditions and the following disclaimer.
Kojto 113:f141b2784e32 17 - Redistributions in binary form must reproduce the above copyright
Kojto 113:f141b2784e32 18 notice, this list of conditions and the following disclaimer in the
Kojto 113:f141b2784e32 19 documentation and/or other materials provided with the distribution.
Kojto 113:f141b2784e32 20 - Neither the name of ARM nor the names of its contributors may be used
Kojto 113:f141b2784e32 21 to endorse or promote products derived from this software without
Kojto 113:f141b2784e32 22 specific prior written permission.
Kojto 113:f141b2784e32 23 *
Kojto 113:f141b2784e32 24 THIS SOFTWARE IS PROVIDED BY THE COPYRIGHT HOLDERS AND CONTRIBUTORS "AS IS"
Kojto 113:f141b2784e32 25 AND ANY EXPRESS OR IMPLIED WARRANTIES, INCLUDING, BUT NOT LIMITED TO, THE
Kojto 113:f141b2784e32 26 IMPLIED WARRANTIES OF MERCHANTABILITY AND FITNESS FOR A PARTICULAR PURPOSE
Kojto 113:f141b2784e32 27 ARE DISCLAIMED. IN NO EVENT SHALL COPYRIGHT HOLDERS AND CONTRIBUTORS BE
Kojto 113:f141b2784e32 28 LIABLE FOR ANY DIRECT, INDIRECT, INCIDENTAL, SPECIAL, EXEMPLARY, OR
Kojto 113:f141b2784e32 29 CONSEQUENTIAL DAMAGES (INCLUDING, BUT NOT LIMITED TO, PROCUREMENT OF
Kojto 113:f141b2784e32 30 SUBSTITUTE GOODS OR SERVICES; LOSS OF USE, DATA, OR PROFITS; OR BUSINESS
Kojto 113:f141b2784e32 31 INTERRUPTION) HOWEVER CAUSED AND ON ANY THEORY OF LIABILITY, WHETHER IN
Kojto 113:f141b2784e32 32 CONTRACT, STRICT LIABILITY, OR TORT (INCLUDING NEGLIGENCE OR OTHERWISE)
Kojto 113:f141b2784e32 33 ARISING IN ANY WAY OUT OF THE USE OF THIS SOFTWARE, EVEN IF ADVISED OF THE
Kojto 113:f141b2784e32 34 POSSIBILITY OF SUCH DAMAGE.
Kojto 113:f141b2784e32 35 ---------------------------------------------------------------------------*/
Kojto 113:f141b2784e32 36
Kojto 113:f141b2784e32 37
Kojto 113:f141b2784e32 38 #ifndef __CORE_CAFUNC_H__
Kojto 113:f141b2784e32 39 #define __CORE_CAFUNC_H__
Kojto 113:f141b2784e32 40
Kojto 113:f141b2784e32 41
Kojto 113:f141b2784e32 42 /* ########################### Core Function Access ########################### */
Kojto 113:f141b2784e32 43 /** \ingroup CMSIS_Core_FunctionInterface
Kojto 113:f141b2784e32 44 \defgroup CMSIS_Core_RegAccFunctions CMSIS Core Register Access Functions
Kojto 113:f141b2784e32 45 @{
Kojto 113:f141b2784e32 46 */
Kojto 113:f141b2784e32 47
Kojto 113:f141b2784e32 48 #if defined ( __CC_ARM ) /*------------------RealView Compiler -----------------*/
Kojto 113:f141b2784e32 49 /* ARM armcc specific functions */
Kojto 113:f141b2784e32 50
Kojto 113:f141b2784e32 51 #if (__ARMCC_VERSION < 400677)
Kojto 113:f141b2784e32 52 #error "Please use ARM Compiler Toolchain V4.0.677 or later!"
Kojto 113:f141b2784e32 53 #endif
Kojto 113:f141b2784e32 54
Kojto 113:f141b2784e32 55 #define MODE_USR 0x10
Kojto 113:f141b2784e32 56 #define MODE_FIQ 0x11
Kojto 113:f141b2784e32 57 #define MODE_IRQ 0x12
Kojto 113:f141b2784e32 58 #define MODE_SVC 0x13
Kojto 113:f141b2784e32 59 #define MODE_MON 0x16
Kojto 113:f141b2784e32 60 #define MODE_ABT 0x17
Kojto 113:f141b2784e32 61 #define MODE_HYP 0x1A
Kojto 113:f141b2784e32 62 #define MODE_UND 0x1B
Kojto 113:f141b2784e32 63 #define MODE_SYS 0x1F
Kojto 113:f141b2784e32 64
Kojto 113:f141b2784e32 65 /** \brief Get APSR Register
Kojto 113:f141b2784e32 66
Kojto 113:f141b2784e32 67 This function returns the content of the APSR Register.
Kojto 113:f141b2784e32 68
Kojto 113:f141b2784e32 69 \return APSR Register value
Kojto 113:f141b2784e32 70 */
Kojto 113:f141b2784e32 71 __STATIC_INLINE uint32_t __get_APSR(void)
Kojto 113:f141b2784e32 72 {
Kojto 113:f141b2784e32 73 register uint32_t __regAPSR __ASM("apsr");
Kojto 113:f141b2784e32 74 return(__regAPSR);
Kojto 113:f141b2784e32 75 }
Kojto 113:f141b2784e32 76
Kojto 113:f141b2784e32 77
Kojto 113:f141b2784e32 78 /** \brief Get CPSR Register
Kojto 113:f141b2784e32 79
Kojto 113:f141b2784e32 80 This function returns the content of the CPSR Register.
Kojto 113:f141b2784e32 81
Kojto 113:f141b2784e32 82 \return CPSR Register value
Kojto 113:f141b2784e32 83 */
Kojto 113:f141b2784e32 84 __STATIC_INLINE uint32_t __get_CPSR(void)
Kojto 113:f141b2784e32 85 {
Kojto 113:f141b2784e32 86 register uint32_t __regCPSR __ASM("cpsr");
Kojto 113:f141b2784e32 87 return(__regCPSR);
Kojto 113:f141b2784e32 88 }
Kojto 113:f141b2784e32 89
Kojto 113:f141b2784e32 90 /** \brief Set Stack Pointer
Kojto 113:f141b2784e32 91
Kojto 113:f141b2784e32 92 This function assigns the given value to the current stack pointer.
Kojto 113:f141b2784e32 93
Kojto 113:f141b2784e32 94 \param [in] topOfStack Stack Pointer value to set
Kojto 113:f141b2784e32 95 */
Kojto 113:f141b2784e32 96 register uint32_t __regSP __ASM("sp");
Kojto 113:f141b2784e32 97 __STATIC_INLINE void __set_SP(uint32_t topOfStack)
Kojto 113:f141b2784e32 98 {
Kojto 113:f141b2784e32 99 __regSP = topOfStack;
Kojto 113:f141b2784e32 100 }
Kojto 113:f141b2784e32 101
Kojto 113:f141b2784e32 102
Kojto 113:f141b2784e32 103 /** \brief Get link register
Kojto 113:f141b2784e32 104
Kojto 113:f141b2784e32 105 This function returns the value of the link register
Kojto 113:f141b2784e32 106
Kojto 113:f141b2784e32 107 \return Value of link register
Kojto 113:f141b2784e32 108 */
Kojto 113:f141b2784e32 109 register uint32_t __reglr __ASM("lr");
Kojto 113:f141b2784e32 110 __STATIC_INLINE uint32_t __get_LR(void)
Kojto 113:f141b2784e32 111 {
Kojto 113:f141b2784e32 112 return(__reglr);
Kojto 113:f141b2784e32 113 }
Kojto 113:f141b2784e32 114
Kojto 113:f141b2784e32 115 /** \brief Set link register
Kojto 113:f141b2784e32 116
Kojto 113:f141b2784e32 117 This function sets the value of the link register
Kojto 113:f141b2784e32 118
Kojto 113:f141b2784e32 119 \param [in] lr LR value to set
Kojto 113:f141b2784e32 120 */
Kojto 113:f141b2784e32 121 __STATIC_INLINE void __set_LR(uint32_t lr)
Kojto 113:f141b2784e32 122 {
Kojto 113:f141b2784e32 123 __reglr = lr;
Kojto 113:f141b2784e32 124 }
Kojto 113:f141b2784e32 125
Kojto 113:f141b2784e32 126 /** \brief Set Process Stack Pointer
Kojto 113:f141b2784e32 127
Kojto 113:f141b2784e32 128 This function assigns the given value to the USR/SYS Stack Pointer (PSP).
Kojto 113:f141b2784e32 129
Kojto 113:f141b2784e32 130 \param [in] topOfProcStack USR/SYS Stack Pointer value to set
Kojto 113:f141b2784e32 131 */
Kojto 113:f141b2784e32 132 __STATIC_ASM void __set_PSP(uint32_t topOfProcStack)
Kojto 113:f141b2784e32 133 {
Kojto 113:f141b2784e32 134 ARM
Kojto 113:f141b2784e32 135 PRESERVE8
Kojto 113:f141b2784e32 136
Kojto 113:f141b2784e32 137 BIC R0, R0, #7 ;ensure stack is 8-byte aligned
Kojto 113:f141b2784e32 138 MRS R1, CPSR
Kojto 113:f141b2784e32 139 CPS #MODE_SYS ;no effect in USR mode
Kojto 113:f141b2784e32 140 MOV SP, R0
Kojto 113:f141b2784e32 141 MSR CPSR_c, R1 ;no effect in USR mode
Kojto 113:f141b2784e32 142 ISB
Kojto 113:f141b2784e32 143 BX LR
Kojto 113:f141b2784e32 144
Kojto 113:f141b2784e32 145 }
Kojto 113:f141b2784e32 146
Kojto 113:f141b2784e32 147 /** \brief Set User Mode
Kojto 113:f141b2784e32 148
Kojto 113:f141b2784e32 149 This function changes the processor state to User Mode
Kojto 113:f141b2784e32 150 */
Kojto 113:f141b2784e32 151 __STATIC_ASM void __set_CPS_USR(void)
Kojto 113:f141b2784e32 152 {
Kojto 113:f141b2784e32 153 ARM
Kojto 113:f141b2784e32 154
Kojto 113:f141b2784e32 155 CPS #MODE_USR
Kojto 113:f141b2784e32 156 BX LR
Kojto 113:f141b2784e32 157 }
Kojto 113:f141b2784e32 158
Kojto 113:f141b2784e32 159
Kojto 113:f141b2784e32 160 /** \brief Enable FIQ
Kojto 113:f141b2784e32 161
Kojto 113:f141b2784e32 162 This function enables FIQ interrupts by clearing the F-bit in the CPSR.
Kojto 113:f141b2784e32 163 Can only be executed in Privileged modes.
Kojto 113:f141b2784e32 164 */
Kojto 113:f141b2784e32 165 #define __enable_fault_irq __enable_fiq
Kojto 113:f141b2784e32 166
Kojto 113:f141b2784e32 167
Kojto 113:f141b2784e32 168 /** \brief Disable FIQ
Kojto 113:f141b2784e32 169
Kojto 113:f141b2784e32 170 This function disables FIQ interrupts by setting the F-bit in the CPSR.
Kojto 113:f141b2784e32 171 Can only be executed in Privileged modes.
Kojto 113:f141b2784e32 172 */
Kojto 113:f141b2784e32 173 #define __disable_fault_irq __disable_fiq
Kojto 113:f141b2784e32 174
Kojto 113:f141b2784e32 175
Kojto 113:f141b2784e32 176 /** \brief Get FPSCR
Kojto 113:f141b2784e32 177
Kojto 113:f141b2784e32 178 This function returns the current value of the Floating Point Status/Control register.
Kojto 113:f141b2784e32 179
Kojto 113:f141b2784e32 180 \return Floating Point Status/Control register value
Kojto 113:f141b2784e32 181 */
Kojto 113:f141b2784e32 182 __STATIC_INLINE uint32_t __get_FPSCR(void)
Kojto 113:f141b2784e32 183 {
Kojto 113:f141b2784e32 184 #if (__FPU_PRESENT == 1) && (__FPU_USED == 1)
Kojto 113:f141b2784e32 185 register uint32_t __regfpscr __ASM("fpscr");
Kojto 113:f141b2784e32 186 return(__regfpscr);
Kojto 113:f141b2784e32 187 #else
Kojto 113:f141b2784e32 188 return(0);
Kojto 113:f141b2784e32 189 #endif
Kojto 113:f141b2784e32 190 }
Kojto 113:f141b2784e32 191
Kojto 113:f141b2784e32 192
Kojto 113:f141b2784e32 193 /** \brief Set FPSCR
Kojto 113:f141b2784e32 194
Kojto 113:f141b2784e32 195 This function assigns the given value to the Floating Point Status/Control register.
Kojto 113:f141b2784e32 196
Kojto 113:f141b2784e32 197 \param [in] fpscr Floating Point Status/Control value to set
Kojto 113:f141b2784e32 198 */
Kojto 113:f141b2784e32 199 __STATIC_INLINE void __set_FPSCR(uint32_t fpscr)
Kojto 113:f141b2784e32 200 {
Kojto 113:f141b2784e32 201 #if (__FPU_PRESENT == 1) && (__FPU_USED == 1)
Kojto 113:f141b2784e32 202 register uint32_t __regfpscr __ASM("fpscr");
Kojto 113:f141b2784e32 203 __regfpscr = (fpscr);
Kojto 113:f141b2784e32 204 #endif
Kojto 113:f141b2784e32 205 }
Kojto 113:f141b2784e32 206
Kojto 113:f141b2784e32 207 /** \brief Get FPEXC
Kojto 113:f141b2784e32 208
Kojto 113:f141b2784e32 209 This function returns the current value of the Floating Point Exception Control register.
Kojto 113:f141b2784e32 210
Kojto 113:f141b2784e32 211 \return Floating Point Exception Control register value
Kojto 113:f141b2784e32 212 */
Kojto 113:f141b2784e32 213 __STATIC_INLINE uint32_t __get_FPEXC(void)
Kojto 113:f141b2784e32 214 {
Kojto 113:f141b2784e32 215 #if (__FPU_PRESENT == 1)
Kojto 113:f141b2784e32 216 register uint32_t __regfpexc __ASM("fpexc");
Kojto 113:f141b2784e32 217 return(__regfpexc);
Kojto 113:f141b2784e32 218 #else
Kojto 113:f141b2784e32 219 return(0);
Kojto 113:f141b2784e32 220 #endif
Kojto 113:f141b2784e32 221 }
Kojto 113:f141b2784e32 222
Kojto 113:f141b2784e32 223
Kojto 113:f141b2784e32 224 /** \brief Set FPEXC
Kojto 113:f141b2784e32 225
Kojto 113:f141b2784e32 226 This function assigns the given value to the Floating Point Exception Control register.
Kojto 113:f141b2784e32 227
Kojto 113:f141b2784e32 228 \param [in] fpscr Floating Point Exception Control value to set
Kojto 113:f141b2784e32 229 */
Kojto 113:f141b2784e32 230 __STATIC_INLINE void __set_FPEXC(uint32_t fpexc)
Kojto 113:f141b2784e32 231 {
Kojto 113:f141b2784e32 232 #if (__FPU_PRESENT == 1)
Kojto 113:f141b2784e32 233 register uint32_t __regfpexc __ASM("fpexc");
Kojto 113:f141b2784e32 234 __regfpexc = (fpexc);
Kojto 113:f141b2784e32 235 #endif
Kojto 113:f141b2784e32 236 }
Kojto 113:f141b2784e32 237
Kojto 113:f141b2784e32 238 /** \brief Get CPACR
Kojto 113:f141b2784e32 239
Kojto 113:f141b2784e32 240 This function returns the current value of the Coprocessor Access Control register.
Kojto 113:f141b2784e32 241
Kojto 113:f141b2784e32 242 \return Coprocessor Access Control register value
Kojto 113:f141b2784e32 243 */
Kojto 113:f141b2784e32 244 __STATIC_INLINE uint32_t __get_CPACR(void)
Kojto 113:f141b2784e32 245 {
Kojto 113:f141b2784e32 246 register uint32_t __regCPACR __ASM("cp15:0:c1:c0:2");
Kojto 113:f141b2784e32 247 return __regCPACR;
Kojto 113:f141b2784e32 248 }
Kojto 113:f141b2784e32 249
Kojto 113:f141b2784e32 250 /** \brief Set CPACR
Kojto 113:f141b2784e32 251
Kojto 113:f141b2784e32 252 This function assigns the given value to the Coprocessor Access Control register.
Kojto 113:f141b2784e32 253
Kojto 113:f141b2784e32 254 \param [in] cpacr Coprocessor Acccess Control value to set
Kojto 113:f141b2784e32 255 */
Kojto 113:f141b2784e32 256 __STATIC_INLINE void __set_CPACR(uint32_t cpacr)
Kojto 113:f141b2784e32 257 {
Kojto 113:f141b2784e32 258 register uint32_t __regCPACR __ASM("cp15:0:c1:c0:2");
Kojto 113:f141b2784e32 259 __regCPACR = cpacr;
Kojto 113:f141b2784e32 260 __ISB();
Kojto 113:f141b2784e32 261 }
Kojto 113:f141b2784e32 262
Kojto 113:f141b2784e32 263 /** \brief Get CBAR
Kojto 113:f141b2784e32 264
Kojto 113:f141b2784e32 265 This function returns the value of the Configuration Base Address register.
Kojto 113:f141b2784e32 266
Kojto 113:f141b2784e32 267 \return Configuration Base Address register value
Kojto 113:f141b2784e32 268 */
Kojto 113:f141b2784e32 269 __STATIC_INLINE uint32_t __get_CBAR() {
Kojto 113:f141b2784e32 270 register uint32_t __regCBAR __ASM("cp15:4:c15:c0:0");
Kojto 113:f141b2784e32 271 return(__regCBAR);
Kojto 113:f141b2784e32 272 }
Kojto 113:f141b2784e32 273
Kojto 113:f141b2784e32 274 /** \brief Get TTBR0
Kojto 113:f141b2784e32 275
Kojto 113:f141b2784e32 276 This function returns the value of the Translation Table Base Register 0.
Kojto 113:f141b2784e32 277
Kojto 113:f141b2784e32 278 \return Translation Table Base Register 0 value
Kojto 113:f141b2784e32 279 */
Kojto 113:f141b2784e32 280 __STATIC_INLINE uint32_t __get_TTBR0() {
Kojto 113:f141b2784e32 281 register uint32_t __regTTBR0 __ASM("cp15:0:c2:c0:0");
Kojto 113:f141b2784e32 282 return(__regTTBR0);
Kojto 113:f141b2784e32 283 }
Kojto 113:f141b2784e32 284
Kojto 113:f141b2784e32 285 /** \brief Set TTBR0
Kojto 113:f141b2784e32 286
Kojto 113:f141b2784e32 287 This function assigns the given value to the Translation Table Base Register 0.
Kojto 113:f141b2784e32 288
Kojto 113:f141b2784e32 289 \param [in] ttbr0 Translation Table Base Register 0 value to set
Kojto 113:f141b2784e32 290 */
Kojto 113:f141b2784e32 291 __STATIC_INLINE void __set_TTBR0(uint32_t ttbr0) {
Kojto 113:f141b2784e32 292 register uint32_t __regTTBR0 __ASM("cp15:0:c2:c0:0");
Kojto 113:f141b2784e32 293 __regTTBR0 = ttbr0;
Kojto 113:f141b2784e32 294 __ISB();
Kojto 113:f141b2784e32 295 }
Kojto 113:f141b2784e32 296
Kojto 113:f141b2784e32 297 /** \brief Get DACR
Kojto 113:f141b2784e32 298
Kojto 113:f141b2784e32 299 This function returns the value of the Domain Access Control Register.
Kojto 113:f141b2784e32 300
Kojto 113:f141b2784e32 301 \return Domain Access Control Register value
Kojto 113:f141b2784e32 302 */
Kojto 113:f141b2784e32 303 __STATIC_INLINE uint32_t __get_DACR() {
Kojto 113:f141b2784e32 304 register uint32_t __regDACR __ASM("cp15:0:c3:c0:0");
Kojto 113:f141b2784e32 305 return(__regDACR);
Kojto 113:f141b2784e32 306 }
Kojto 113:f141b2784e32 307
Kojto 113:f141b2784e32 308 /** \brief Set DACR
Kojto 113:f141b2784e32 309
Kojto 113:f141b2784e32 310 This function assigns the given value to the Domain Access Control Register.
Kojto 113:f141b2784e32 311
Kojto 113:f141b2784e32 312 \param [in] dacr Domain Access Control Register value to set
Kojto 113:f141b2784e32 313 */
Kojto 113:f141b2784e32 314 __STATIC_INLINE void __set_DACR(uint32_t dacr) {
Kojto 113:f141b2784e32 315 register uint32_t __regDACR __ASM("cp15:0:c3:c0:0");
Kojto 113:f141b2784e32 316 __regDACR = dacr;
Kojto 113:f141b2784e32 317 __ISB();
Kojto 113:f141b2784e32 318 }
Kojto 113:f141b2784e32 319
Kojto 113:f141b2784e32 320 /******************************** Cache and BTAC enable ****************************************************/
Kojto 113:f141b2784e32 321
Kojto 113:f141b2784e32 322 /** \brief Set SCTLR
Kojto 113:f141b2784e32 323
Kojto 113:f141b2784e32 324 This function assigns the given value to the System Control Register.
Kojto 113:f141b2784e32 325
Kojto 113:f141b2784e32 326 \param [in] sctlr System Control Register value to set
Kojto 113:f141b2784e32 327 */
Kojto 113:f141b2784e32 328 __STATIC_INLINE void __set_SCTLR(uint32_t sctlr)
Kojto 113:f141b2784e32 329 {
Kojto 113:f141b2784e32 330 register uint32_t __regSCTLR __ASM("cp15:0:c1:c0:0");
Kojto 113:f141b2784e32 331 __regSCTLR = sctlr;
Kojto 113:f141b2784e32 332 }
Kojto 113:f141b2784e32 333
Kojto 113:f141b2784e32 334 /** \brief Get SCTLR
Kojto 113:f141b2784e32 335
Kojto 113:f141b2784e32 336 This function returns the value of the System Control Register.
Kojto 113:f141b2784e32 337
Kojto 113:f141b2784e32 338 \return System Control Register value
Kojto 113:f141b2784e32 339 */
Kojto 113:f141b2784e32 340 __STATIC_INLINE uint32_t __get_SCTLR() {
Kojto 113:f141b2784e32 341 register uint32_t __regSCTLR __ASM("cp15:0:c1:c0:0");
Kojto 113:f141b2784e32 342 return(__regSCTLR);
Kojto 113:f141b2784e32 343 }
Kojto 113:f141b2784e32 344
Kojto 113:f141b2784e32 345 /** \brief Enable Caches
Kojto 113:f141b2784e32 346
Kojto 113:f141b2784e32 347 Enable Caches
Kojto 113:f141b2784e32 348 */
Kojto 113:f141b2784e32 349 __STATIC_INLINE void __enable_caches(void) {
Kojto 113:f141b2784e32 350 // Set I bit 12 to enable I Cache
Kojto 113:f141b2784e32 351 // Set C bit 2 to enable D Cache
Kojto 113:f141b2784e32 352 __set_SCTLR( __get_SCTLR() | (1 << 12) | (1 << 2));
Kojto 113:f141b2784e32 353 }
Kojto 113:f141b2784e32 354
Kojto 113:f141b2784e32 355 /** \brief Disable Caches
Kojto 113:f141b2784e32 356
Kojto 113:f141b2784e32 357 Disable Caches
Kojto 113:f141b2784e32 358 */
Kojto 113:f141b2784e32 359 __STATIC_INLINE void __disable_caches(void) {
Kojto 113:f141b2784e32 360 // Clear I bit 12 to disable I Cache
Kojto 113:f141b2784e32 361 // Clear C bit 2 to disable D Cache
Kojto 113:f141b2784e32 362 __set_SCTLR( __get_SCTLR() & ~(1 << 12) & ~(1 << 2));
Kojto 113:f141b2784e32 363 __ISB();
Kojto 113:f141b2784e32 364 }
Kojto 113:f141b2784e32 365
Kojto 113:f141b2784e32 366 /** \brief Enable BTAC
Kojto 113:f141b2784e32 367
Kojto 113:f141b2784e32 368 Enable BTAC
Kojto 113:f141b2784e32 369 */
Kojto 113:f141b2784e32 370 __STATIC_INLINE void __enable_btac(void) {
Kojto 113:f141b2784e32 371 // Set Z bit 11 to enable branch prediction
Kojto 113:f141b2784e32 372 __set_SCTLR( __get_SCTLR() | (1 << 11));
Kojto 113:f141b2784e32 373 __ISB();
Kojto 113:f141b2784e32 374 }
Kojto 113:f141b2784e32 375
Kojto 113:f141b2784e32 376 /** \brief Disable BTAC
Kojto 113:f141b2784e32 377
Kojto 113:f141b2784e32 378 Disable BTAC
Kojto 113:f141b2784e32 379 */
Kojto 113:f141b2784e32 380 __STATIC_INLINE void __disable_btac(void) {
Kojto 113:f141b2784e32 381 // Clear Z bit 11 to disable branch prediction
Kojto 113:f141b2784e32 382 __set_SCTLR( __get_SCTLR() & ~(1 << 11));
Kojto 113:f141b2784e32 383 }
Kojto 113:f141b2784e32 384
Kojto 113:f141b2784e32 385
Kojto 113:f141b2784e32 386 /** \brief Enable MMU
Kojto 113:f141b2784e32 387
Kojto 113:f141b2784e32 388 Enable MMU
Kojto 113:f141b2784e32 389 */
Kojto 113:f141b2784e32 390 __STATIC_INLINE void __enable_mmu(void) {
Kojto 113:f141b2784e32 391 // Set M bit 0 to enable the MMU
Kojto 113:f141b2784e32 392 // Set AFE bit to enable simplified access permissions model
Kojto 113:f141b2784e32 393 // Clear TRE bit to disable TEX remap and A bit to disable strict alignment fault checking
Kojto 113:f141b2784e32 394 __set_SCTLR( (__get_SCTLR() & ~(1 << 28) & ~(1 << 1)) | 1 | (1 << 29));
Kojto 113:f141b2784e32 395 __ISB();
Kojto 113:f141b2784e32 396 }
Kojto 113:f141b2784e32 397
Kojto 113:f141b2784e32 398 /** \brief Disable MMU
Kojto 113:f141b2784e32 399
Kojto 113:f141b2784e32 400 Disable MMU
Kojto 113:f141b2784e32 401 */
Kojto 113:f141b2784e32 402 __STATIC_INLINE void __disable_mmu(void) {
Kojto 113:f141b2784e32 403 // Clear M bit 0 to disable the MMU
Kojto 113:f141b2784e32 404 __set_SCTLR( __get_SCTLR() & ~1);
Kojto 113:f141b2784e32 405 __ISB();
Kojto 113:f141b2784e32 406 }
Kojto 113:f141b2784e32 407
Kojto 113:f141b2784e32 408 /******************************** TLB maintenance operations ************************************************/
Kojto 113:f141b2784e32 409 /** \brief Invalidate the whole tlb
Kojto 113:f141b2784e32 410
Kojto 113:f141b2784e32 411 TLBIALL. Invalidate the whole tlb
Kojto 113:f141b2784e32 412 */
Kojto 113:f141b2784e32 413
Kojto 113:f141b2784e32 414 __STATIC_INLINE void __ca9u_inv_tlb_all(void) {
Kojto 113:f141b2784e32 415 register uint32_t __TLBIALL __ASM("cp15:0:c8:c7:0");
Kojto 113:f141b2784e32 416 __TLBIALL = 0;
Kojto 113:f141b2784e32 417 __DSB();
Kojto 113:f141b2784e32 418 __ISB();
Kojto 113:f141b2784e32 419 }
Kojto 113:f141b2784e32 420
Kojto 113:f141b2784e32 421 /******************************** BTB maintenance operations ************************************************/
Kojto 113:f141b2784e32 422 /** \brief Invalidate entire branch predictor array
Kojto 113:f141b2784e32 423
Kojto 113:f141b2784e32 424 BPIALL. Branch Predictor Invalidate All.
Kojto 113:f141b2784e32 425 */
Kojto 113:f141b2784e32 426
Kojto 113:f141b2784e32 427 __STATIC_INLINE void __v7_inv_btac(void) {
Kojto 113:f141b2784e32 428 register uint32_t __BPIALL __ASM("cp15:0:c7:c5:6");
Kojto 113:f141b2784e32 429 __BPIALL = 0;
Kojto 113:f141b2784e32 430 __DSB(); //ensure completion of the invalidation
Kojto 113:f141b2784e32 431 __ISB(); //ensure instruction fetch path sees new state
Kojto 113:f141b2784e32 432 }
Kojto 113:f141b2784e32 433
Kojto 113:f141b2784e32 434
Kojto 113:f141b2784e32 435 /******************************** L1 cache operations ******************************************************/
Kojto 113:f141b2784e32 436
Kojto 113:f141b2784e32 437 /** \brief Invalidate the whole I$
Kojto 113:f141b2784e32 438
Kojto 113:f141b2784e32 439 ICIALLU. Instruction Cache Invalidate All to PoU
Kojto 113:f141b2784e32 440 */
Kojto 113:f141b2784e32 441 __STATIC_INLINE void __v7_inv_icache_all(void) {
Kojto 113:f141b2784e32 442 register uint32_t __ICIALLU __ASM("cp15:0:c7:c5:0");
Kojto 113:f141b2784e32 443 __ICIALLU = 0;
Kojto 113:f141b2784e32 444 __DSB(); //ensure completion of the invalidation
Kojto 113:f141b2784e32 445 __ISB(); //ensure instruction fetch path sees new I cache state
Kojto 113:f141b2784e32 446 }
Kojto 113:f141b2784e32 447
Kojto 113:f141b2784e32 448 /** \brief Clean D$ by MVA
Kojto 113:f141b2784e32 449
Kojto 113:f141b2784e32 450 DCCMVAC. Data cache clean by MVA to PoC
Kojto 113:f141b2784e32 451 */
Kojto 113:f141b2784e32 452 __STATIC_INLINE void __v7_clean_dcache_mva(void *va) {
Kojto 113:f141b2784e32 453 register uint32_t __DCCMVAC __ASM("cp15:0:c7:c10:1");
Kojto 113:f141b2784e32 454 __DCCMVAC = (uint32_t)va;
Kojto 113:f141b2784e32 455 __DMB(); //ensure the ordering of data cache maintenance operations and their effects
Kojto 113:f141b2784e32 456 }
Kojto 113:f141b2784e32 457
Kojto 113:f141b2784e32 458 /** \brief Invalidate D$ by MVA
Kojto 113:f141b2784e32 459
Kojto 113:f141b2784e32 460 DCIMVAC. Data cache invalidate by MVA to PoC
Kojto 113:f141b2784e32 461 */
Kojto 113:f141b2784e32 462 __STATIC_INLINE void __v7_inv_dcache_mva(void *va) {
Kojto 113:f141b2784e32 463 register uint32_t __DCIMVAC __ASM("cp15:0:c7:c6:1");
Kojto 113:f141b2784e32 464 __DCIMVAC = (uint32_t)va;
Kojto 113:f141b2784e32 465 __DMB(); //ensure the ordering of data cache maintenance operations and their effects
Kojto 113:f141b2784e32 466 }
Kojto 113:f141b2784e32 467
Kojto 113:f141b2784e32 468 /** \brief Clean and Invalidate D$ by MVA
Kojto 113:f141b2784e32 469
Kojto 113:f141b2784e32 470 DCCIMVAC. Data cache clean and invalidate by MVA to PoC
Kojto 113:f141b2784e32 471 */
Kojto 113:f141b2784e32 472 __STATIC_INLINE void __v7_clean_inv_dcache_mva(void *va) {
Kojto 113:f141b2784e32 473 register uint32_t __DCCIMVAC __ASM("cp15:0:c7:c14:1");
Kojto 113:f141b2784e32 474 __DCCIMVAC = (uint32_t)va;
Kojto 113:f141b2784e32 475 __DMB(); //ensure the ordering of data cache maintenance operations and their effects
Kojto 113:f141b2784e32 476 }
Kojto 113:f141b2784e32 477
Kojto 113:f141b2784e32 478 /** \brief Clean and Invalidate the entire data or unified cache
Kojto 113:f141b2784e32 479
Kojto 113:f141b2784e32 480 Generic mechanism for cleaning/invalidating the entire data or unified cache to the point of coherency.
Kojto 113:f141b2784e32 481 */
Kojto 113:f141b2784e32 482 #pragma push
Kojto 113:f141b2784e32 483 #pragma arm
Kojto 113:f141b2784e32 484 __STATIC_ASM void __v7_all_cache(uint32_t op) {
Kojto 113:f141b2784e32 485 ARM
Kojto 113:f141b2784e32 486
Kojto 113:f141b2784e32 487 PUSH {R4-R11}
Kojto 113:f141b2784e32 488
Kojto 113:f141b2784e32 489 MRC p15, 1, R6, c0, c0, 1 // Read CLIDR
Kojto 113:f141b2784e32 490 ANDS R3, R6, #0x07000000 // Extract coherency level
Kojto 113:f141b2784e32 491 MOV R3, R3, LSR #23 // Total cache levels << 1
Kojto 113:f141b2784e32 492 BEQ Finished // If 0, no need to clean
Kojto 113:f141b2784e32 493
Kojto 113:f141b2784e32 494 MOV R10, #0 // R10 holds current cache level << 1
Kojto 113:f141b2784e32 495 Loop1 ADD R2, R10, R10, LSR #1 // R2 holds cache "Set" position
Kojto 113:f141b2784e32 496 MOV R1, R6, LSR R2 // Bottom 3 bits are the Cache-type for this level
Kojto 113:f141b2784e32 497 AND R1, R1, #7 // Isolate those lower 3 bits
Kojto 113:f141b2784e32 498 CMP R1, #2
Kojto 113:f141b2784e32 499 BLT Skip // No cache or only instruction cache at this level
Kojto 113:f141b2784e32 500
Kojto 113:f141b2784e32 501 MCR p15, 2, R10, c0, c0, 0 // Write the Cache Size selection register
Kojto 113:f141b2784e32 502 ISB // ISB to sync the change to the CacheSizeID reg
Kojto 113:f141b2784e32 503 MRC p15, 1, R1, c0, c0, 0 // Reads current Cache Size ID register
Kojto 113:f141b2784e32 504 AND R2, R1, #7 // Extract the line length field
Kojto 113:f141b2784e32 505 ADD R2, R2, #4 // Add 4 for the line length offset (log2 16 bytes)
Kojto 113:f141b2784e32 506 LDR R4, =0x3FF
Kojto 113:f141b2784e32 507 ANDS R4, R4, R1, LSR #3 // R4 is the max number on the way size (right aligned)
Kojto 113:f141b2784e32 508 CLZ R5, R4 // R5 is the bit position of the way size increment
Kojto 113:f141b2784e32 509 LDR R7, =0x7FFF
Kojto 113:f141b2784e32 510 ANDS R7, R7, R1, LSR #13 // R7 is the max number of the index size (right aligned)
Kojto 113:f141b2784e32 511
Kojto 113:f141b2784e32 512 Loop2 MOV R9, R4 // R9 working copy of the max way size (right aligned)
Kojto 113:f141b2784e32 513
Kojto 113:f141b2784e32 514 Loop3 ORR R11, R10, R9, LSL R5 // Factor in the Way number and cache number into R11
Kojto 113:f141b2784e32 515 ORR R11, R11, R7, LSL R2 // Factor in the Set number
Kojto 113:f141b2784e32 516 CMP R0, #0
Kojto 113:f141b2784e32 517 BNE Dccsw
Kojto 113:f141b2784e32 518 MCR p15, 0, R11, c7, c6, 2 // DCISW. Invalidate by Set/Way
Kojto 113:f141b2784e32 519 B cont
Kojto 113:f141b2784e32 520 Dccsw CMP R0, #1
Kojto 113:f141b2784e32 521 BNE Dccisw
Kojto 113:f141b2784e32 522 MCR p15, 0, R11, c7, c10, 2 // DCCSW. Clean by Set/Way
Kojto 113:f141b2784e32 523 B cont
Kojto 113:f141b2784e32 524 Dccisw MCR p15, 0, R11, c7, c14, 2 // DCCISW. Clean and Invalidate by Set/Way
Kojto 113:f141b2784e32 525 cont SUBS R9, R9, #1 // Decrement the Way number
Kojto 113:f141b2784e32 526 BGE Loop3
Kojto 113:f141b2784e32 527 SUBS R7, R7, #1 // Decrement the Set number
Kojto 113:f141b2784e32 528 BGE Loop2
Kojto 113:f141b2784e32 529 Skip ADD R10, R10, #2 // Increment the cache number
Kojto 113:f141b2784e32 530 CMP R3, R10
Kojto 113:f141b2784e32 531 BGT Loop1
Kojto 113:f141b2784e32 532
Kojto 113:f141b2784e32 533 Finished
Kojto 113:f141b2784e32 534 DSB
Kojto 113:f141b2784e32 535 POP {R4-R11}
Kojto 113:f141b2784e32 536 BX lr
Kojto 113:f141b2784e32 537
Kojto 113:f141b2784e32 538 }
Kojto 113:f141b2784e32 539 #pragma pop
Kojto 113:f141b2784e32 540
Kojto 113:f141b2784e32 541
Kojto 113:f141b2784e32 542 /** \brief Invalidate the whole D$
Kojto 113:f141b2784e32 543
Kojto 113:f141b2784e32 544 DCISW. Invalidate by Set/Way
Kojto 113:f141b2784e32 545 */
Kojto 113:f141b2784e32 546
Kojto 113:f141b2784e32 547 __STATIC_INLINE void __v7_inv_dcache_all(void) {
Kojto 113:f141b2784e32 548 __v7_all_cache(0);
Kojto 113:f141b2784e32 549 }
Kojto 113:f141b2784e32 550
Kojto 113:f141b2784e32 551 /** \brief Clean the whole D$
Kojto 113:f141b2784e32 552
Kojto 113:f141b2784e32 553 DCCSW. Clean by Set/Way
Kojto 113:f141b2784e32 554 */
Kojto 113:f141b2784e32 555
Kojto 113:f141b2784e32 556 __STATIC_INLINE void __v7_clean_dcache_all(void) {
Kojto 113:f141b2784e32 557 __v7_all_cache(1);
Kojto 113:f141b2784e32 558 }
Kojto 113:f141b2784e32 559
Kojto 113:f141b2784e32 560 /** \brief Clean and invalidate the whole D$
Kojto 113:f141b2784e32 561
Kojto 113:f141b2784e32 562 DCCISW. Clean and Invalidate by Set/Way
Kojto 113:f141b2784e32 563 */
Kojto 113:f141b2784e32 564
Kojto 113:f141b2784e32 565 __STATIC_INLINE void __v7_clean_inv_dcache_all(void) {
Kojto 113:f141b2784e32 566 __v7_all_cache(2);
Kojto 113:f141b2784e32 567 }
Kojto 113:f141b2784e32 568
Kojto 113:f141b2784e32 569 #include "core_ca_mmu.h"
Kojto 113:f141b2784e32 570
Kojto 113:f141b2784e32 571 #elif (defined (__ICCARM__)) /*---------------- ICC Compiler ---------------------*/
Kojto 113:f141b2784e32 572
Kojto 115:87f2f5183dfb 573 #define __inline inline
Kojto 115:87f2f5183dfb 574
Kojto 115:87f2f5183dfb 575 inline static uint32_t __disable_irq_iar() {
Kojto 115:87f2f5183dfb 576 int irq_dis = __get_CPSR() & 0x80; // 7bit CPSR.I
Kojto 115:87f2f5183dfb 577 __disable_irq();
Kojto 115:87f2f5183dfb 578 return irq_dis;
Kojto 115:87f2f5183dfb 579 }
Kojto 115:87f2f5183dfb 580
Kojto 115:87f2f5183dfb 581 #define MODE_USR 0x10
Kojto 115:87f2f5183dfb 582 #define MODE_FIQ 0x11
Kojto 115:87f2f5183dfb 583 #define MODE_IRQ 0x12
Kojto 115:87f2f5183dfb 584 #define MODE_SVC 0x13
Kojto 115:87f2f5183dfb 585 #define MODE_MON 0x16
Kojto 115:87f2f5183dfb 586 #define MODE_ABT 0x17
Kojto 115:87f2f5183dfb 587 #define MODE_HYP 0x1A
Kojto 115:87f2f5183dfb 588 #define MODE_UND 0x1B
Kojto 115:87f2f5183dfb 589 #define MODE_SYS 0x1F
Kojto 115:87f2f5183dfb 590
Kojto 115:87f2f5183dfb 591 /** \brief Set Process Stack Pointer
Kojto 115:87f2f5183dfb 592
Kojto 115:87f2f5183dfb 593 This function assigns the given value to the USR/SYS Stack Pointer (PSP).
Kojto 115:87f2f5183dfb 594
Kojto 115:87f2f5183dfb 595 \param [in] topOfProcStack USR/SYS Stack Pointer value to set
Kojto 115:87f2f5183dfb 596 */
Kojto 115:87f2f5183dfb 597 // from rt_CMSIS.c
Kojto 115:87f2f5183dfb 598 __arm static inline void __set_PSP(uint32_t topOfProcStack) {
Kojto 115:87f2f5183dfb 599 __asm(
Kojto 115:87f2f5183dfb 600 " ARM\n"
Kojto 115:87f2f5183dfb 601 // " PRESERVE8\n"
Kojto 115:87f2f5183dfb 602
Kojto 115:87f2f5183dfb 603 " BIC R0, R0, #7 ;ensure stack is 8-byte aligned \n"
Kojto 115:87f2f5183dfb 604 " MRS R1, CPSR \n"
Kojto 115:87f2f5183dfb 605 " CPS #0x1F ;no effect in USR mode \n" // MODE_SYS
Kojto 115:87f2f5183dfb 606 " MOV SP, R0 \n"
Kojto 115:87f2f5183dfb 607 " MSR CPSR_c, R1 ;no effect in USR mode \n"
Kojto 115:87f2f5183dfb 608 " ISB \n"
Kojto 115:87f2f5183dfb 609 " BX LR \n");
Kojto 115:87f2f5183dfb 610 }
Kojto 115:87f2f5183dfb 611
Kojto 115:87f2f5183dfb 612 /** \brief Set User Mode
Kojto 115:87f2f5183dfb 613
Kojto 115:87f2f5183dfb 614 This function changes the processor state to User Mode
Kojto 115:87f2f5183dfb 615 */
Kojto 115:87f2f5183dfb 616 // from rt_CMSIS.c
Kojto 115:87f2f5183dfb 617 __arm static inline void __set_CPS_USR(void) {
Kojto 115:87f2f5183dfb 618 __asm(
Kojto 115:87f2f5183dfb 619 " ARM \n"
Kojto 115:87f2f5183dfb 620
Kojto 115:87f2f5183dfb 621 " CPS #0x10 \n" // MODE_USR
Kojto 115:87f2f5183dfb 622 " BX LR\n");
Kojto 115:87f2f5183dfb 623 }
Kojto 115:87f2f5183dfb 624
Kojto 115:87f2f5183dfb 625 /** \brief Set TTBR0
Kojto 115:87f2f5183dfb 626
Kojto 115:87f2f5183dfb 627 This function assigns the given value to the Translation Table Base Register 0.
Kojto 115:87f2f5183dfb 628
Kojto 115:87f2f5183dfb 629 \param [in] ttbr0 Translation Table Base Register 0 value to set
Kojto 115:87f2f5183dfb 630 */
Kojto 115:87f2f5183dfb 631 // from mmu_Renesas_RZ_A1.c
Kojto 115:87f2f5183dfb 632 __STATIC_INLINE void __set_TTBR0(uint32_t ttbr0) {
Kojto 115:87f2f5183dfb 633 __MCR(15, 0, ttbr0, 2, 0, 0); // reg to cp15
Kojto 115:87f2f5183dfb 634 __ISB();
Kojto 115:87f2f5183dfb 635 }
Kojto 115:87f2f5183dfb 636
Kojto 115:87f2f5183dfb 637 /** \brief Set DACR
Kojto 115:87f2f5183dfb 638
Kojto 115:87f2f5183dfb 639 This function assigns the given value to the Domain Access Control Register.
Kojto 115:87f2f5183dfb 640
Kojto 115:87f2f5183dfb 641 \param [in] dacr Domain Access Control Register value to set
Kojto 115:87f2f5183dfb 642 */
Kojto 115:87f2f5183dfb 643 // from mmu_Renesas_RZ_A1.c
Kojto 115:87f2f5183dfb 644 __STATIC_INLINE void __set_DACR(uint32_t dacr) {
Kojto 115:87f2f5183dfb 645 __MCR(15, 0, dacr, 3, 0, 0); // reg to cp15
Kojto 115:87f2f5183dfb 646 __ISB();
Kojto 115:87f2f5183dfb 647 }
Kojto 115:87f2f5183dfb 648
Kojto 115:87f2f5183dfb 649
Kojto 115:87f2f5183dfb 650 /******************************** Cache and BTAC enable ****************************************************/
Kojto 115:87f2f5183dfb 651 /** \brief Set SCTLR
Kojto 115:87f2f5183dfb 652
Kojto 115:87f2f5183dfb 653 This function assigns the given value to the System Control Register.
Kojto 115:87f2f5183dfb 654
Kojto 115:87f2f5183dfb 655 \param [in] sctlr System Control Register value to set
Kojto 115:87f2f5183dfb 656 */
Kojto 115:87f2f5183dfb 657 // from __enable_mmu()
Kojto 115:87f2f5183dfb 658 __STATIC_INLINE void __set_SCTLR(uint32_t sctlr) {
Kojto 115:87f2f5183dfb 659 __MCR(15, 0, sctlr, 1, 0, 0); // reg to cp15
Kojto 115:87f2f5183dfb 660 }
Kojto 115:87f2f5183dfb 661
Kojto 115:87f2f5183dfb 662 /** \brief Get SCTLR
Kojto 115:87f2f5183dfb 663
Kojto 115:87f2f5183dfb 664 This function returns the value of the System Control Register.
Kojto 115:87f2f5183dfb 665
Kojto 115:87f2f5183dfb 666 \return System Control Register value
Kojto 115:87f2f5183dfb 667 */
Kojto 115:87f2f5183dfb 668 // from __enable_mmu()
Kojto 115:87f2f5183dfb 669 __STATIC_INLINE uint32_t __get_SCTLR() {
Kojto 115:87f2f5183dfb 670 uint32_t __regSCTLR = __MRC(15, 0, 1, 0, 0);
Kojto 115:87f2f5183dfb 671 return __regSCTLR;
Kojto 115:87f2f5183dfb 672 }
Kojto 115:87f2f5183dfb 673
Kojto 115:87f2f5183dfb 674 /** \brief Enable Caches
Kojto 115:87f2f5183dfb 675
Kojto 115:87f2f5183dfb 676 Enable Caches
Kojto 115:87f2f5183dfb 677 */
Kojto 115:87f2f5183dfb 678 // from system_Renesas_RZ_A1.c
Kojto 115:87f2f5183dfb 679 __STATIC_INLINE void __enable_caches(void) {
Kojto 115:87f2f5183dfb 680 __set_SCTLR( __get_SCTLR() | (1 << 12) | (1 << 2));
Kojto 115:87f2f5183dfb 681 }
Kojto 115:87f2f5183dfb 682
Kojto 115:87f2f5183dfb 683 /** \brief Enable BTAC
Kojto 115:87f2f5183dfb 684
Kojto 115:87f2f5183dfb 685 Enable BTAC
Kojto 115:87f2f5183dfb 686 */
Kojto 115:87f2f5183dfb 687 // from system_Renesas_RZ_A1.c
Kojto 115:87f2f5183dfb 688 __STATIC_INLINE void __enable_btac(void) {
Kojto 115:87f2f5183dfb 689 __set_SCTLR( __get_SCTLR() | (1 << 11));
Kojto 115:87f2f5183dfb 690 __ISB();
Kojto 115:87f2f5183dfb 691 }
Kojto 115:87f2f5183dfb 692
Kojto 115:87f2f5183dfb 693 /** \brief Enable MMU
Kojto 115:87f2f5183dfb 694
Kojto 115:87f2f5183dfb 695 Enable MMU
Kojto 115:87f2f5183dfb 696 */
Kojto 115:87f2f5183dfb 697 // from system_Renesas_RZ_A1.c
Kojto 115:87f2f5183dfb 698 __STATIC_INLINE void __enable_mmu(void) {
Kojto 115:87f2f5183dfb 699 // Set M bit 0 to enable the MMU
Kojto 115:87f2f5183dfb 700 // Set AFE bit to enable simplified access permissions model
Kojto 115:87f2f5183dfb 701 // Clear TRE bit to disable TEX remap and A bit to disable strict alignment fault checking
Kojto 115:87f2f5183dfb 702 __set_SCTLR( (__get_SCTLR() & ~(1 << 28) & ~(1 << 1)) | 1 | (1 << 29));
Kojto 115:87f2f5183dfb 703 __ISB();
Kojto 115:87f2f5183dfb 704 }
Kojto 115:87f2f5183dfb 705
Kojto 115:87f2f5183dfb 706 /******************************** TLB maintenance operations ************************************************/
Kojto 115:87f2f5183dfb 707 /** \brief Invalidate the whole tlb
Kojto 115:87f2f5183dfb 708
Kojto 115:87f2f5183dfb 709 TLBIALL. Invalidate the whole tlb
Kojto 115:87f2f5183dfb 710 */
Kojto 115:87f2f5183dfb 711 // from system_Renesas_RZ_A1.c
Kojto 115:87f2f5183dfb 712 __STATIC_INLINE void __ca9u_inv_tlb_all(void) {
Kojto 115:87f2f5183dfb 713 uint32_t val = 0;
Kojto 115:87f2f5183dfb 714 __MCR(15, 0, val, 8, 7, 0); // reg to cp15
Kojto 115:87f2f5183dfb 715 __MCR(15, 0, val, 8, 6, 0); // reg to cp15
Kojto 115:87f2f5183dfb 716 __MCR(15, 0, val, 8, 5, 0); // reg to cp15
Kojto 115:87f2f5183dfb 717 __DSB();
Kojto 115:87f2f5183dfb 718 __ISB();
Kojto 115:87f2f5183dfb 719 }
Kojto 115:87f2f5183dfb 720
Kojto 115:87f2f5183dfb 721 /******************************** BTB maintenance operations ************************************************/
Kojto 115:87f2f5183dfb 722 /** \brief Invalidate entire branch predictor array
Kojto 115:87f2f5183dfb 723
Kojto 115:87f2f5183dfb 724 BPIALL. Branch Predictor Invalidate All.
Kojto 115:87f2f5183dfb 725 */
Kojto 115:87f2f5183dfb 726 // from system_Renesas_RZ_A1.c
Kojto 115:87f2f5183dfb 727 __STATIC_INLINE void __v7_inv_btac(void) {
Kojto 115:87f2f5183dfb 728 uint32_t val = 0;
Kojto 115:87f2f5183dfb 729 __MCR(15, 0, val, 7, 5, 6); // reg to cp15
Kojto 115:87f2f5183dfb 730 __DSB(); //ensure completion of the invalidation
Kojto 115:87f2f5183dfb 731 __ISB(); //ensure instruction fetch path sees new state
Kojto 115:87f2f5183dfb 732 }
Kojto 115:87f2f5183dfb 733
Kojto 115:87f2f5183dfb 734
Kojto 115:87f2f5183dfb 735 /******************************** L1 cache operations ******************************************************/
Kojto 115:87f2f5183dfb 736
Kojto 115:87f2f5183dfb 737 /** \brief Invalidate the whole I$
Kojto 115:87f2f5183dfb 738
Kojto 115:87f2f5183dfb 739 ICIALLU. Instruction Cache Invalidate All to PoU
Kojto 115:87f2f5183dfb 740 */
Kojto 115:87f2f5183dfb 741 // from system_Renesas_RZ_A1.c
Kojto 115:87f2f5183dfb 742 __STATIC_INLINE void __v7_inv_icache_all(void) {
Kojto 115:87f2f5183dfb 743 uint32_t val = 0;
Kojto 115:87f2f5183dfb 744 __MCR(15, 0, val, 7, 5, 0); // reg to cp15
Kojto 115:87f2f5183dfb 745 __DSB(); //ensure completion of the invalidation
Kojto 115:87f2f5183dfb 746 __ISB(); //ensure instruction fetch path sees new I cache state
Kojto 115:87f2f5183dfb 747 }
Kojto 115:87f2f5183dfb 748
Kojto 115:87f2f5183dfb 749 // from __v7_inv_dcache_all()
Kojto 115:87f2f5183dfb 750 __arm static inline void __v7_all_cache(uint32_t op) {
Kojto 115:87f2f5183dfb 751 __asm(
Kojto 115:87f2f5183dfb 752 " ARM \n"
Kojto 115:87f2f5183dfb 753
Kojto 115:87f2f5183dfb 754 " PUSH {R4-R11} \n"
Kojto 115:87f2f5183dfb 755
Kojto 115:87f2f5183dfb 756 " MRC p15, 1, R6, c0, c0, 1\n" // Read CLIDR
Kojto 115:87f2f5183dfb 757 " ANDS R3, R6, #0x07000000\n" // Extract coherency level
Kojto 115:87f2f5183dfb 758 " MOV R3, R3, LSR #23\n" // Total cache levels << 1
Kojto 115:87f2f5183dfb 759 " BEQ Finished\n" // If 0, no need to clean
Kojto 115:87f2f5183dfb 760
Kojto 115:87f2f5183dfb 761 " MOV R10, #0\n" // R10 holds current cache level << 1
Kojto 115:87f2f5183dfb 762 "Loop1: ADD R2, R10, R10, LSR #1\n" // R2 holds cache "Set" position
Kojto 115:87f2f5183dfb 763 " MOV R1, R6, LSR R2 \n" // Bottom 3 bits are the Cache-type for this level
Kojto 115:87f2f5183dfb 764 " AND R1, R1, #7 \n" // Isolate those lower 3 bits
Kojto 115:87f2f5183dfb 765 " CMP R1, #2 \n"
Kojto 115:87f2f5183dfb 766 " BLT Skip \n" // No cache or only instruction cache at this level
Kojto 115:87f2f5183dfb 767
Kojto 115:87f2f5183dfb 768 " MCR p15, 2, R10, c0, c0, 0 \n" // Write the Cache Size selection register
Kojto 115:87f2f5183dfb 769 " ISB \n" // ISB to sync the change to the CacheSizeID reg
Kojto 115:87f2f5183dfb 770 " MRC p15, 1, R1, c0, c0, 0 \n" // Reads current Cache Size ID register
Kojto 115:87f2f5183dfb 771 " AND R2, R1, #7 \n" // Extract the line length field
Kojto 115:87f2f5183dfb 772 " ADD R2, R2, #4 \n" // Add 4 for the line length offset (log2 16 bytes)
Kojto 115:87f2f5183dfb 773 " movw R4, #0x3FF \n"
Kojto 115:87f2f5183dfb 774 " ANDS R4, R4, R1, LSR #3 \n" // R4 is the max number on the way size (right aligned)
Kojto 115:87f2f5183dfb 775 " CLZ R5, R4 \n" // R5 is the bit position of the way size increment
Kojto 115:87f2f5183dfb 776 " movw R7, #0x7FFF \n"
Kojto 115:87f2f5183dfb 777 " ANDS R7, R7, R1, LSR #13 \n" // R7 is the max number of the index size (right aligned)
Kojto 115:87f2f5183dfb 778
Kojto 115:87f2f5183dfb 779 "Loop2: MOV R9, R4 \n" // R9 working copy of the max way size (right aligned)
Kojto 115:87f2f5183dfb 780
Kojto 115:87f2f5183dfb 781 "Loop3: ORR R11, R10, R9, LSL R5 \n" // Factor in the Way number and cache number into R11
Kojto 115:87f2f5183dfb 782 " ORR R11, R11, R7, LSL R2 \n" // Factor in the Set number
Kojto 115:87f2f5183dfb 783 " CMP R0, #0 \n"
Kojto 115:87f2f5183dfb 784 " BNE Dccsw \n"
Kojto 115:87f2f5183dfb 785 " MCR p15, 0, R11, c7, c6, 2 \n" // DCISW. Invalidate by Set/Way
Kojto 115:87f2f5183dfb 786 " B cont \n"
Kojto 115:87f2f5183dfb 787 "Dccsw: CMP R0, #1 \n"
Kojto 115:87f2f5183dfb 788 " BNE Dccisw \n"
Kojto 115:87f2f5183dfb 789 " MCR p15, 0, R11, c7, c10, 2 \n" // DCCSW. Clean by Set/Way
Kojto 115:87f2f5183dfb 790 " B cont \n"
Kojto 115:87f2f5183dfb 791 "Dccisw: MCR p15, 0, R11, c7, c14, 2 \n" // DCCISW, Clean and Invalidate by Set/Way
Kojto 115:87f2f5183dfb 792 "cont: SUBS R9, R9, #1 \n" // Decrement the Way number
Kojto 115:87f2f5183dfb 793 " BGE Loop3 \n"
Kojto 115:87f2f5183dfb 794 " SUBS R7, R7, #1 \n" // Decrement the Set number
Kojto 115:87f2f5183dfb 795 " BGE Loop2 \n"
Kojto 115:87f2f5183dfb 796 "Skip: ADD R10, R10, #2 \n" // increment the cache number
Kojto 115:87f2f5183dfb 797 " CMP R3, R10 \n"
Kojto 115:87f2f5183dfb 798 " BGT Loop1 \n"
Kojto 115:87f2f5183dfb 799
Kojto 115:87f2f5183dfb 800 "Finished: \n"
Kojto 115:87f2f5183dfb 801 " DSB \n"
Kojto 115:87f2f5183dfb 802 " POP {R4-R11} \n"
Kojto 115:87f2f5183dfb 803 " BX lr \n" );
Kojto 115:87f2f5183dfb 804 }
Kojto 115:87f2f5183dfb 805
Kojto 115:87f2f5183dfb 806 /** \brief Invalidate the whole D$
Kojto 115:87f2f5183dfb 807
Kojto 115:87f2f5183dfb 808 DCISW. Invalidate by Set/Way
Kojto 115:87f2f5183dfb 809 */
Kojto 115:87f2f5183dfb 810 // from system_Renesas_RZ_A1.c
Kojto 115:87f2f5183dfb 811 __STATIC_INLINE void __v7_inv_dcache_all(void) {
Kojto 115:87f2f5183dfb 812 __v7_all_cache(0);
Kojto 115:87f2f5183dfb 813 }
<> 130:d75b3fe1f5cb 814 /** \brief Clean the whole D$
<> 130:d75b3fe1f5cb 815
<> 130:d75b3fe1f5cb 816 DCCSW. Clean by Set/Way
<> 130:d75b3fe1f5cb 817 */
<> 130:d75b3fe1f5cb 818
<> 130:d75b3fe1f5cb 819 __STATIC_INLINE void __v7_clean_dcache_all(void) {
<> 130:d75b3fe1f5cb 820 __v7_all_cache(1);
<> 130:d75b3fe1f5cb 821 }
<> 130:d75b3fe1f5cb 822
<> 130:d75b3fe1f5cb 823 /** \brief Clean and invalidate the whole D$
<> 130:d75b3fe1f5cb 824
<> 130:d75b3fe1f5cb 825 DCCISW. Clean and Invalidate by Set/Way
<> 130:d75b3fe1f5cb 826 */
<> 130:d75b3fe1f5cb 827
<> 130:d75b3fe1f5cb 828 __STATIC_INLINE void __v7_clean_inv_dcache_all(void) {
<> 130:d75b3fe1f5cb 829 __v7_all_cache(2);
<> 130:d75b3fe1f5cb 830 }
Kojto 121:6c34061e7c34 831 /** \brief Clean and Invalidate D$ by MVA
Kojto 121:6c34061e7c34 832
Kojto 121:6c34061e7c34 833 DCCIMVAC. Data cache clean and invalidate by MVA to PoC
Kojto 121:6c34061e7c34 834 */
Kojto 121:6c34061e7c34 835 __STATIC_INLINE void __v7_clean_inv_dcache_mva(void *va) {
Kojto 121:6c34061e7c34 836 __MCR(15, 0, (uint32_t)va, 7, 14, 1);
Kojto 121:6c34061e7c34 837 __DMB();
Kojto 121:6c34061e7c34 838 }
Kojto 121:6c34061e7c34 839
Kojto 115:87f2f5183dfb 840 #include "core_ca_mmu.h"
Kojto 113:f141b2784e32 841
Kojto 113:f141b2784e32 842 #elif (defined (__GNUC__)) /*------------------ GNU Compiler ---------------------*/
Kojto 113:f141b2784e32 843 /* GNU gcc specific functions */
Kojto 113:f141b2784e32 844
Kojto 113:f141b2784e32 845 #define MODE_USR 0x10
Kojto 113:f141b2784e32 846 #define MODE_FIQ 0x11
Kojto 113:f141b2784e32 847 #define MODE_IRQ 0x12
Kojto 113:f141b2784e32 848 #define MODE_SVC 0x13
Kojto 113:f141b2784e32 849 #define MODE_MON 0x16
Kojto 113:f141b2784e32 850 #define MODE_ABT 0x17
Kojto 113:f141b2784e32 851 #define MODE_HYP 0x1A
Kojto 113:f141b2784e32 852 #define MODE_UND 0x1B
Kojto 113:f141b2784e32 853 #define MODE_SYS 0x1F
Kojto 113:f141b2784e32 854
Kojto 113:f141b2784e32 855
Kojto 113:f141b2784e32 856 __attribute__( ( always_inline ) ) __STATIC_INLINE void __enable_irq(void)
Kojto 113:f141b2784e32 857 {
Kojto 113:f141b2784e32 858 __ASM volatile ("cpsie i");
Kojto 113:f141b2784e32 859 }
Kojto 113:f141b2784e32 860
Kojto 113:f141b2784e32 861 /** \brief Disable IRQ Interrupts
Kojto 113:f141b2784e32 862
Kojto 113:f141b2784e32 863 This function disables IRQ interrupts by setting the I-bit in the CPSR.
Kojto 113:f141b2784e32 864 Can only be executed in Privileged modes.
Kojto 113:f141b2784e32 865 */
Kojto 113:f141b2784e32 866 __attribute__( ( always_inline ) ) __STATIC_INLINE uint32_t __disable_irq(void)
Kojto 113:f141b2784e32 867 {
Kojto 113:f141b2784e32 868 uint32_t result;
Kojto 113:f141b2784e32 869
Kojto 113:f141b2784e32 870 __ASM volatile ("mrs %0, cpsr" : "=r" (result));
Kojto 113:f141b2784e32 871 __ASM volatile ("cpsid i");
Kojto 113:f141b2784e32 872 return(result & 0x80);
Kojto 113:f141b2784e32 873 }
Kojto 113:f141b2784e32 874
Kojto 113:f141b2784e32 875
Kojto 113:f141b2784e32 876 /** \brief Get APSR Register
Kojto 113:f141b2784e32 877
Kojto 113:f141b2784e32 878 This function returns the content of the APSR Register.
Kojto 113:f141b2784e32 879
Kojto 113:f141b2784e32 880 \return APSR Register value
Kojto 113:f141b2784e32 881 */
Kojto 113:f141b2784e32 882 __attribute__( ( always_inline ) ) __STATIC_INLINE uint32_t __get_APSR(void)
Kojto 113:f141b2784e32 883 {
Kojto 113:f141b2784e32 884 #if 1
Kojto 113:f141b2784e32 885 register uint32_t __regAPSR;
Kojto 113:f141b2784e32 886 __ASM volatile ("mrs %0, apsr" : "=r" (__regAPSR) );
Kojto 113:f141b2784e32 887 #else
Kojto 113:f141b2784e32 888 register uint32_t __regAPSR __ASM("apsr");
Kojto 113:f141b2784e32 889 #endif
Kojto 113:f141b2784e32 890 return(__regAPSR);
Kojto 113:f141b2784e32 891 }
Kojto 113:f141b2784e32 892
Kojto 113:f141b2784e32 893
Kojto 113:f141b2784e32 894 /** \brief Get CPSR Register
Kojto 113:f141b2784e32 895
Kojto 113:f141b2784e32 896 This function returns the content of the CPSR Register.
Kojto 113:f141b2784e32 897
Kojto 113:f141b2784e32 898 \return CPSR Register value
Kojto 113:f141b2784e32 899 */
Kojto 113:f141b2784e32 900 __attribute__( ( always_inline ) ) __STATIC_INLINE uint32_t __get_CPSR(void)
Kojto 113:f141b2784e32 901 {
Kojto 113:f141b2784e32 902 #if 1
Kojto 113:f141b2784e32 903 register uint32_t __regCPSR;
Kojto 113:f141b2784e32 904 __ASM volatile ("mrs %0, cpsr" : "=r" (__regCPSR));
Kojto 113:f141b2784e32 905 #else
Kojto 113:f141b2784e32 906 register uint32_t __regCPSR __ASM("cpsr");
Kojto 113:f141b2784e32 907 #endif
Kojto 113:f141b2784e32 908 return(__regCPSR);
Kojto 113:f141b2784e32 909 }
Kojto 113:f141b2784e32 910
Kojto 113:f141b2784e32 911 #if 0
Kojto 113:f141b2784e32 912 /** \brief Set Stack Pointer
Kojto 113:f141b2784e32 913
Kojto 113:f141b2784e32 914 This function assigns the given value to the current stack pointer.
Kojto 113:f141b2784e32 915
Kojto 113:f141b2784e32 916 \param [in] topOfStack Stack Pointer value to set
Kojto 113:f141b2784e32 917 */
Kojto 113:f141b2784e32 918 __attribute__( ( always_inline ) ) __STATIC_INLINE void __set_SP(uint32_t topOfStack)
Kojto 113:f141b2784e32 919 {
Kojto 113:f141b2784e32 920 register uint32_t __regSP __ASM("sp");
Kojto 113:f141b2784e32 921 __regSP = topOfStack;
Kojto 113:f141b2784e32 922 }
Kojto 113:f141b2784e32 923 #endif
Kojto 113:f141b2784e32 924
Kojto 113:f141b2784e32 925 /** \brief Get link register
Kojto 113:f141b2784e32 926
Kojto 113:f141b2784e32 927 This function returns the value of the link register
Kojto 113:f141b2784e32 928
Kojto 113:f141b2784e32 929 \return Value of link register
Kojto 113:f141b2784e32 930 */
Kojto 113:f141b2784e32 931 __attribute__( ( always_inline ) ) __STATIC_INLINE uint32_t __get_LR(void)
Kojto 113:f141b2784e32 932 {
Kojto 113:f141b2784e32 933 register uint32_t __reglr __ASM("lr");
Kojto 113:f141b2784e32 934 return(__reglr);
Kojto 113:f141b2784e32 935 }
Kojto 113:f141b2784e32 936
Kojto 113:f141b2784e32 937 #if 0
Kojto 113:f141b2784e32 938 /** \brief Set link register
Kojto 113:f141b2784e32 939
Kojto 113:f141b2784e32 940 This function sets the value of the link register
Kojto 113:f141b2784e32 941
Kojto 113:f141b2784e32 942 \param [in] lr LR value to set
Kojto 113:f141b2784e32 943 */
Kojto 113:f141b2784e32 944 __attribute__( ( always_inline ) ) __STATIC_INLINE void __set_LR(uint32_t lr)
Kojto 113:f141b2784e32 945 {
Kojto 113:f141b2784e32 946 register uint32_t __reglr __ASM("lr");
Kojto 113:f141b2784e32 947 __reglr = lr;
Kojto 113:f141b2784e32 948 }
Kojto 113:f141b2784e32 949 #endif
Kojto 113:f141b2784e32 950
Kojto 113:f141b2784e32 951 /** \brief Set Process Stack Pointer
Kojto 113:f141b2784e32 952
Kojto 113:f141b2784e32 953 This function assigns the given value to the USR/SYS Stack Pointer (PSP).
Kojto 113:f141b2784e32 954
Kojto 113:f141b2784e32 955 \param [in] topOfProcStack USR/SYS Stack Pointer value to set
Kojto 113:f141b2784e32 956 */
Kojto 113:f141b2784e32 957 __attribute__( ( always_inline ) ) __STATIC_INLINE void __set_PSP(uint32_t topOfProcStack)
Kojto 113:f141b2784e32 958 {
Kojto 113:f141b2784e32 959 __asm__ volatile (
Kojto 113:f141b2784e32 960 ".ARM;"
Kojto 113:f141b2784e32 961 ".eabi_attribute Tag_ABI_align8_preserved,1;"
Kojto 113:f141b2784e32 962
Kojto 113:f141b2784e32 963 "BIC R0, R0, #7;" /* ;ensure stack is 8-byte aligned */
Kojto 113:f141b2784e32 964 "MRS R1, CPSR;"
Kojto 113:f141b2784e32 965 "CPS %0;" /* ;no effect in USR mode */
Kojto 113:f141b2784e32 966 "MOV SP, R0;"
Kojto 113:f141b2784e32 967 "MSR CPSR_c, R1;" /* ;no effect in USR mode */
Kojto 113:f141b2784e32 968 "ISB;"
Kojto 113:f141b2784e32 969 //"BX LR;"
Kojto 113:f141b2784e32 970 :
Kojto 113:f141b2784e32 971 : "i"(MODE_SYS)
Kojto 113:f141b2784e32 972 : "r0", "r1");
Kojto 113:f141b2784e32 973 return;
Kojto 113:f141b2784e32 974 }
Kojto 113:f141b2784e32 975
Kojto 113:f141b2784e32 976 /** \brief Set User Mode
Kojto 113:f141b2784e32 977
Kojto 113:f141b2784e32 978 This function changes the processor state to User Mode
Kojto 113:f141b2784e32 979 */
Kojto 113:f141b2784e32 980 __attribute__( ( always_inline ) ) __STATIC_INLINE void __set_CPS_USR(void)
Kojto 113:f141b2784e32 981 {
Kojto 113:f141b2784e32 982 __asm__ volatile (
Kojto 113:f141b2784e32 983 ".ARM;"
Kojto 113:f141b2784e32 984
Kojto 113:f141b2784e32 985 "CPS %0;"
Kojto 113:f141b2784e32 986 //"BX LR;"
Kojto 113:f141b2784e32 987 :
Kojto 113:f141b2784e32 988 : "i"(MODE_USR)
Kojto 113:f141b2784e32 989 : );
Kojto 113:f141b2784e32 990 return;
Kojto 113:f141b2784e32 991 }
Kojto 113:f141b2784e32 992
Kojto 113:f141b2784e32 993
Kojto 113:f141b2784e32 994 /** \brief Enable FIQ
Kojto 113:f141b2784e32 995
Kojto 113:f141b2784e32 996 This function enables FIQ interrupts by clearing the F-bit in the CPSR.
Kojto 113:f141b2784e32 997 Can only be executed in Privileged modes.
Kojto 113:f141b2784e32 998 */
Kojto 113:f141b2784e32 999 #define __enable_fault_irq() __asm__ volatile ("cpsie f")
Kojto 113:f141b2784e32 1000
Kojto 113:f141b2784e32 1001
Kojto 113:f141b2784e32 1002 /** \brief Disable FIQ
Kojto 113:f141b2784e32 1003
Kojto 113:f141b2784e32 1004 This function disables FIQ interrupts by setting the F-bit in the CPSR.
Kojto 113:f141b2784e32 1005 Can only be executed in Privileged modes.
Kojto 113:f141b2784e32 1006 */
Kojto 113:f141b2784e32 1007 #define __disable_fault_irq() __asm__ volatile ("cpsid f")
Kojto 113:f141b2784e32 1008
Kojto 113:f141b2784e32 1009
Kojto 113:f141b2784e32 1010 /** \brief Get FPSCR
Kojto 113:f141b2784e32 1011
Kojto 113:f141b2784e32 1012 This function returns the current value of the Floating Point Status/Control register.
Kojto 113:f141b2784e32 1013
Kojto 113:f141b2784e32 1014 \return Floating Point Status/Control register value
Kojto 113:f141b2784e32 1015 */
Kojto 113:f141b2784e32 1016 __attribute__( ( always_inline ) ) __STATIC_INLINE uint32_t __get_FPSCR(void)
Kojto 113:f141b2784e32 1017 {
Kojto 113:f141b2784e32 1018 #if (__FPU_PRESENT == 1) && (__FPU_USED == 1)
Kojto 113:f141b2784e32 1019 #if 1
Kojto 113:f141b2784e32 1020 uint32_t result;
Kojto 113:f141b2784e32 1021
Kojto 113:f141b2784e32 1022 __ASM volatile ("vmrs %0, fpscr" : "=r" (result) );
Kojto 113:f141b2784e32 1023 return (result);
Kojto 113:f141b2784e32 1024 #else
Kojto 113:f141b2784e32 1025 register uint32_t __regfpscr __ASM("fpscr");
Kojto 113:f141b2784e32 1026 return(__regfpscr);
Kojto 113:f141b2784e32 1027 #endif
Kojto 113:f141b2784e32 1028 #else
Kojto 113:f141b2784e32 1029 return(0);
Kojto 113:f141b2784e32 1030 #endif
Kojto 113:f141b2784e32 1031 }
Kojto 113:f141b2784e32 1032
Kojto 113:f141b2784e32 1033
Kojto 113:f141b2784e32 1034 /** \brief Set FPSCR
Kojto 113:f141b2784e32 1035
Kojto 113:f141b2784e32 1036 This function assigns the given value to the Floating Point Status/Control register.
Kojto 113:f141b2784e32 1037
Kojto 113:f141b2784e32 1038 \param [in] fpscr Floating Point Status/Control value to set
Kojto 113:f141b2784e32 1039 */
Kojto 113:f141b2784e32 1040 __attribute__( ( always_inline ) ) __STATIC_INLINE void __set_FPSCR(uint32_t fpscr)
Kojto 113:f141b2784e32 1041 {
Kojto 113:f141b2784e32 1042 #if (__FPU_PRESENT == 1) && (__FPU_USED == 1)
Kojto 113:f141b2784e32 1043 #if 1
Kojto 113:f141b2784e32 1044 __ASM volatile ("vmsr fpscr, %0" : : "r" (fpscr) );
Kojto 113:f141b2784e32 1045 #else
Kojto 113:f141b2784e32 1046 register uint32_t __regfpscr __ASM("fpscr");
Kojto 113:f141b2784e32 1047 __regfpscr = (fpscr);
Kojto 113:f141b2784e32 1048 #endif
Kojto 113:f141b2784e32 1049 #endif
Kojto 113:f141b2784e32 1050 }
Kojto 113:f141b2784e32 1051
Kojto 113:f141b2784e32 1052 /** \brief Get FPEXC
Kojto 113:f141b2784e32 1053
Kojto 113:f141b2784e32 1054 This function returns the current value of the Floating Point Exception Control register.
Kojto 113:f141b2784e32 1055
Kojto 113:f141b2784e32 1056 \return Floating Point Exception Control register value
Kojto 113:f141b2784e32 1057 */
Kojto 113:f141b2784e32 1058 __attribute__( ( always_inline ) ) __STATIC_INLINE uint32_t __get_FPEXC(void)
Kojto 113:f141b2784e32 1059 {
Kojto 113:f141b2784e32 1060 #if (__FPU_PRESENT == 1)
Kojto 113:f141b2784e32 1061 #if 1
Kojto 113:f141b2784e32 1062 uint32_t result;
Kojto 113:f141b2784e32 1063
Kojto 113:f141b2784e32 1064 __ASM volatile ("vmrs %0, fpexc" : "=r" (result));
Kojto 113:f141b2784e32 1065 return (result);
Kojto 113:f141b2784e32 1066 #else
Kojto 113:f141b2784e32 1067 register uint32_t __regfpexc __ASM("fpexc");
Kojto 113:f141b2784e32 1068 return(__regfpexc);
Kojto 113:f141b2784e32 1069 #endif
Kojto 113:f141b2784e32 1070 #else
Kojto 113:f141b2784e32 1071 return(0);
Kojto 113:f141b2784e32 1072 #endif
Kojto 113:f141b2784e32 1073 }
Kojto 113:f141b2784e32 1074
Kojto 113:f141b2784e32 1075
Kojto 113:f141b2784e32 1076 /** \brief Set FPEXC
Kojto 113:f141b2784e32 1077
Kojto 113:f141b2784e32 1078 This function assigns the given value to the Floating Point Exception Control register.
Kojto 113:f141b2784e32 1079
Kojto 113:f141b2784e32 1080 \param [in] fpscr Floating Point Exception Control value to set
Kojto 113:f141b2784e32 1081 */
Kojto 113:f141b2784e32 1082 __attribute__( ( always_inline ) ) __STATIC_INLINE void __set_FPEXC(uint32_t fpexc)
Kojto 113:f141b2784e32 1083 {
Kojto 113:f141b2784e32 1084 #if (__FPU_PRESENT == 1)
Kojto 113:f141b2784e32 1085 #if 1
Kojto 113:f141b2784e32 1086 __ASM volatile ("vmsr fpexc, %0" : : "r" (fpexc));
Kojto 113:f141b2784e32 1087 #else
Kojto 113:f141b2784e32 1088 register uint32_t __regfpexc __ASM("fpexc");
Kojto 113:f141b2784e32 1089 __regfpexc = (fpexc);
Kojto 113:f141b2784e32 1090 #endif
Kojto 113:f141b2784e32 1091 #endif
Kojto 113:f141b2784e32 1092 }
Kojto 113:f141b2784e32 1093
Kojto 113:f141b2784e32 1094 /** \brief Get CPACR
Kojto 113:f141b2784e32 1095
Kojto 113:f141b2784e32 1096 This function returns the current value of the Coprocessor Access Control register.
Kojto 113:f141b2784e32 1097
Kojto 113:f141b2784e32 1098 \return Coprocessor Access Control register value
Kojto 113:f141b2784e32 1099 */
Kojto 113:f141b2784e32 1100 __attribute__( ( always_inline ) ) __STATIC_INLINE uint32_t __get_CPACR(void)
Kojto 113:f141b2784e32 1101 {
Kojto 113:f141b2784e32 1102 #if 1
Kojto 113:f141b2784e32 1103 register uint32_t __regCPACR;
Kojto 113:f141b2784e32 1104 __ASM volatile ("mrc p15, 0, %0, c1, c0, 2" : "=r" (__regCPACR));
Kojto 113:f141b2784e32 1105 #else
Kojto 113:f141b2784e32 1106 register uint32_t __regCPACR __ASM("cp15:0:c1:c0:2");
Kojto 113:f141b2784e32 1107 #endif
Kojto 113:f141b2784e32 1108 return __regCPACR;
Kojto 113:f141b2784e32 1109 }
Kojto 113:f141b2784e32 1110
Kojto 113:f141b2784e32 1111 /** \brief Set CPACR
Kojto 113:f141b2784e32 1112
Kojto 113:f141b2784e32 1113 This function assigns the given value to the Coprocessor Access Control register.
Kojto 113:f141b2784e32 1114
Kojto 113:f141b2784e32 1115 \param [in] cpacr Coprocessor Acccess Control value to set
Kojto 113:f141b2784e32 1116 */
Kojto 113:f141b2784e32 1117 __attribute__( ( always_inline ) ) __STATIC_INLINE void __set_CPACR(uint32_t cpacr)
Kojto 113:f141b2784e32 1118 {
Kojto 113:f141b2784e32 1119 #if 1
Kojto 113:f141b2784e32 1120 __ASM volatile ("mcr p15, 0, %0, c1, c0, 2" : : "r" (cpacr));
Kojto 113:f141b2784e32 1121 #else
Kojto 113:f141b2784e32 1122 register uint32_t __regCPACR __ASM("cp15:0:c1:c0:2");
Kojto 113:f141b2784e32 1123 __regCPACR = cpacr;
Kojto 113:f141b2784e32 1124 #endif
Kojto 113:f141b2784e32 1125 __ISB();
Kojto 113:f141b2784e32 1126 }
Kojto 113:f141b2784e32 1127
Kojto 113:f141b2784e32 1128 /** \brief Get CBAR
Kojto 113:f141b2784e32 1129
Kojto 113:f141b2784e32 1130 This function returns the value of the Configuration Base Address register.
Kojto 113:f141b2784e32 1131
Kojto 113:f141b2784e32 1132 \return Configuration Base Address register value
Kojto 113:f141b2784e32 1133 */
Kojto 113:f141b2784e32 1134 __attribute__( ( always_inline ) ) __STATIC_INLINE uint32_t __get_CBAR() {
Kojto 113:f141b2784e32 1135 #if 1
Kojto 113:f141b2784e32 1136 register uint32_t __regCBAR;
Kojto 113:f141b2784e32 1137 __ASM volatile ("mrc p15, 4, %0, c15, c0, 0" : "=r" (__regCBAR));
Kojto 113:f141b2784e32 1138 #else
Kojto 113:f141b2784e32 1139 register uint32_t __regCBAR __ASM("cp15:4:c15:c0:0");
Kojto 113:f141b2784e32 1140 #endif
Kojto 113:f141b2784e32 1141 return(__regCBAR);
Kojto 113:f141b2784e32 1142 }
Kojto 113:f141b2784e32 1143
Kojto 113:f141b2784e32 1144 /** \brief Get TTBR0
Kojto 113:f141b2784e32 1145
Kojto 113:f141b2784e32 1146 This function returns the value of the Translation Table Base Register 0.
Kojto 113:f141b2784e32 1147
Kojto 113:f141b2784e32 1148 \return Translation Table Base Register 0 value
Kojto 113:f141b2784e32 1149 */
Kojto 113:f141b2784e32 1150 __attribute__( ( always_inline ) ) __STATIC_INLINE uint32_t __get_TTBR0() {
Kojto 113:f141b2784e32 1151 #if 1
Kojto 113:f141b2784e32 1152 register uint32_t __regTTBR0;
Kojto 113:f141b2784e32 1153 __ASM volatile ("mrc p15, 0, %0, c2, c0, 0" : "=r" (__regTTBR0));
Kojto 113:f141b2784e32 1154 #else
Kojto 113:f141b2784e32 1155 register uint32_t __regTTBR0 __ASM("cp15:0:c2:c0:0");
Kojto 113:f141b2784e32 1156 #endif
Kojto 113:f141b2784e32 1157 return(__regTTBR0);
Kojto 113:f141b2784e32 1158 }
Kojto 113:f141b2784e32 1159
Kojto 113:f141b2784e32 1160 /** \brief Set TTBR0
Kojto 113:f141b2784e32 1161
Kojto 113:f141b2784e32 1162 This function assigns the given value to the Translation Table Base Register 0.
Kojto 113:f141b2784e32 1163
Kojto 113:f141b2784e32 1164 \param [in] ttbr0 Translation Table Base Register 0 value to set
Kojto 113:f141b2784e32 1165 */
Kojto 113:f141b2784e32 1166 __attribute__( ( always_inline ) ) __STATIC_INLINE void __set_TTBR0(uint32_t ttbr0) {
Kojto 113:f141b2784e32 1167 #if 1
Kojto 113:f141b2784e32 1168 __ASM volatile ("mcr p15, 0, %0, c2, c0, 0" : : "r" (ttbr0));
Kojto 113:f141b2784e32 1169 #else
Kojto 113:f141b2784e32 1170 register uint32_t __regTTBR0 __ASM("cp15:0:c2:c0:0");
Kojto 113:f141b2784e32 1171 __regTTBR0 = ttbr0;
Kojto 113:f141b2784e32 1172 #endif
Kojto 113:f141b2784e32 1173 __ISB();
Kojto 113:f141b2784e32 1174 }
Kojto 113:f141b2784e32 1175
Kojto 113:f141b2784e32 1176 /** \brief Get DACR
Kojto 113:f141b2784e32 1177
Kojto 113:f141b2784e32 1178 This function returns the value of the Domain Access Control Register.
Kojto 113:f141b2784e32 1179
Kojto 113:f141b2784e32 1180 \return Domain Access Control Register value
Kojto 113:f141b2784e32 1181 */
Kojto 113:f141b2784e32 1182 __attribute__( ( always_inline ) ) __STATIC_INLINE uint32_t __get_DACR() {
Kojto 113:f141b2784e32 1183 #if 1
Kojto 113:f141b2784e32 1184 register uint32_t __regDACR;
Kojto 113:f141b2784e32 1185 __ASM volatile ("mrc p15, 0, %0, c3, c0, 0" : "=r" (__regDACR));
Kojto 113:f141b2784e32 1186 #else
Kojto 113:f141b2784e32 1187 register uint32_t __regDACR __ASM("cp15:0:c3:c0:0");
Kojto 113:f141b2784e32 1188 #endif
Kojto 113:f141b2784e32 1189 return(__regDACR);
Kojto 113:f141b2784e32 1190 }
Kojto 113:f141b2784e32 1191
Kojto 113:f141b2784e32 1192 /** \brief Set DACR
Kojto 113:f141b2784e32 1193
Kojto 113:f141b2784e32 1194 This function assigns the given value to the Domain Access Control Register.
Kojto 113:f141b2784e32 1195
Kojto 113:f141b2784e32 1196 \param [in] dacr Domain Access Control Register value to set
Kojto 113:f141b2784e32 1197 */
Kojto 113:f141b2784e32 1198 __attribute__( ( always_inline ) ) __STATIC_INLINE void __set_DACR(uint32_t dacr) {
Kojto 113:f141b2784e32 1199 #if 1
Kojto 113:f141b2784e32 1200 __ASM volatile ("mcr p15, 0, %0, c3, c0, 0" : : "r" (dacr));
Kojto 113:f141b2784e32 1201 #else
Kojto 113:f141b2784e32 1202 register uint32_t __regDACR __ASM("cp15:0:c3:c0:0");
Kojto 113:f141b2784e32 1203 __regDACR = dacr;
Kojto 113:f141b2784e32 1204 #endif
Kojto 113:f141b2784e32 1205 __ISB();
Kojto 113:f141b2784e32 1206 }
Kojto 113:f141b2784e32 1207
Kojto 113:f141b2784e32 1208 /******************************** Cache and BTAC enable ****************************************************/
Kojto 113:f141b2784e32 1209
Kojto 113:f141b2784e32 1210 /** \brief Set SCTLR
Kojto 113:f141b2784e32 1211
Kojto 113:f141b2784e32 1212 This function assigns the given value to the System Control Register.
Kojto 113:f141b2784e32 1213
Kojto 113:f141b2784e32 1214 \param [in] sctlr System Control Register value to set
Kojto 113:f141b2784e32 1215 */
Kojto 113:f141b2784e32 1216 __attribute__( ( always_inline ) ) __STATIC_INLINE void __set_SCTLR(uint32_t sctlr)
Kojto 113:f141b2784e32 1217 {
Kojto 113:f141b2784e32 1218 #if 1
Kojto 113:f141b2784e32 1219 __ASM volatile ("mcr p15, 0, %0, c1, c0, 0" : : "r" (sctlr));
Kojto 113:f141b2784e32 1220 #else
Kojto 113:f141b2784e32 1221 register uint32_t __regSCTLR __ASM("cp15:0:c1:c0:0");
Kojto 113:f141b2784e32 1222 __regSCTLR = sctlr;
Kojto 113:f141b2784e32 1223 #endif
Kojto 113:f141b2784e32 1224 }
Kojto 113:f141b2784e32 1225
Kojto 113:f141b2784e32 1226 /** \brief Get SCTLR
Kojto 113:f141b2784e32 1227
Kojto 113:f141b2784e32 1228 This function returns the value of the System Control Register.
Kojto 113:f141b2784e32 1229
Kojto 113:f141b2784e32 1230 \return System Control Register value
Kojto 113:f141b2784e32 1231 */
Kojto 113:f141b2784e32 1232 __attribute__( ( always_inline ) ) __STATIC_INLINE uint32_t __get_SCTLR() {
Kojto 113:f141b2784e32 1233 #if 1
Kojto 113:f141b2784e32 1234 register uint32_t __regSCTLR;
Kojto 113:f141b2784e32 1235 __ASM volatile ("mrc p15, 0, %0, c1, c0, 0" : "=r" (__regSCTLR));
Kojto 113:f141b2784e32 1236 #else
Kojto 113:f141b2784e32 1237 register uint32_t __regSCTLR __ASM("cp15:0:c1:c0:0");
Kojto 113:f141b2784e32 1238 #endif
Kojto 113:f141b2784e32 1239 return(__regSCTLR);
Kojto 113:f141b2784e32 1240 }
Kojto 113:f141b2784e32 1241
Kojto 113:f141b2784e32 1242 /** \brief Enable Caches
Kojto 113:f141b2784e32 1243
Kojto 113:f141b2784e32 1244 Enable Caches
Kojto 113:f141b2784e32 1245 */
Kojto 113:f141b2784e32 1246 __attribute__( ( always_inline ) ) __STATIC_INLINE void __enable_caches(void) {
Kojto 113:f141b2784e32 1247 // Set I bit 12 to enable I Cache
Kojto 113:f141b2784e32 1248 // Set C bit 2 to enable D Cache
Kojto 113:f141b2784e32 1249 __set_SCTLR( __get_SCTLR() | (1 << 12) | (1 << 2));
Kojto 113:f141b2784e32 1250 }
Kojto 113:f141b2784e32 1251
Kojto 113:f141b2784e32 1252 /** \brief Disable Caches
Kojto 113:f141b2784e32 1253
Kojto 113:f141b2784e32 1254 Disable Caches
Kojto 113:f141b2784e32 1255 */
Kojto 113:f141b2784e32 1256 __attribute__( ( always_inline ) ) __STATIC_INLINE void __disable_caches(void) {
Kojto 113:f141b2784e32 1257 // Clear I bit 12 to disable I Cache
Kojto 113:f141b2784e32 1258 // Clear C bit 2 to disable D Cache
Kojto 113:f141b2784e32 1259 __set_SCTLR( __get_SCTLR() & ~(1 << 12) & ~(1 << 2));
Kojto 113:f141b2784e32 1260 __ISB();
Kojto 113:f141b2784e32 1261 }
Kojto 113:f141b2784e32 1262
Kojto 113:f141b2784e32 1263 /** \brief Enable BTAC
Kojto 113:f141b2784e32 1264
Kojto 113:f141b2784e32 1265 Enable BTAC
Kojto 113:f141b2784e32 1266 */
Kojto 113:f141b2784e32 1267 __attribute__( ( always_inline ) ) __STATIC_INLINE void __enable_btac(void) {
Kojto 113:f141b2784e32 1268 // Set Z bit 11 to enable branch prediction
Kojto 113:f141b2784e32 1269 __set_SCTLR( __get_SCTLR() | (1 << 11));
Kojto 113:f141b2784e32 1270 __ISB();
Kojto 113:f141b2784e32 1271 }
Kojto 113:f141b2784e32 1272
Kojto 113:f141b2784e32 1273 /** \brief Disable BTAC
Kojto 113:f141b2784e32 1274
Kojto 113:f141b2784e32 1275 Disable BTAC
Kojto 113:f141b2784e32 1276 */
Kojto 113:f141b2784e32 1277 __attribute__( ( always_inline ) ) __STATIC_INLINE void __disable_btac(void) {
Kojto 113:f141b2784e32 1278 // Clear Z bit 11 to disable branch prediction
Kojto 113:f141b2784e32 1279 __set_SCTLR( __get_SCTLR() & ~(1 << 11));
Kojto 113:f141b2784e32 1280 }
Kojto 113:f141b2784e32 1281
Kojto 113:f141b2784e32 1282
Kojto 113:f141b2784e32 1283 /** \brief Enable MMU
Kojto 113:f141b2784e32 1284
Kojto 113:f141b2784e32 1285 Enable MMU
Kojto 113:f141b2784e32 1286 */
Kojto 113:f141b2784e32 1287 __attribute__( ( always_inline ) ) __STATIC_INLINE void __enable_mmu(void) {
Kojto 113:f141b2784e32 1288 // Set M bit 0 to enable the MMU
Kojto 113:f141b2784e32 1289 // Set AFE bit to enable simplified access permissions model
Kojto 113:f141b2784e32 1290 // Clear TRE bit to disable TEX remap and A bit to disable strict alignment fault checking
Kojto 113:f141b2784e32 1291 __set_SCTLR( (__get_SCTLR() & ~(1 << 28) & ~(1 << 1)) | 1 | (1 << 29));
Kojto 113:f141b2784e32 1292 __ISB();
Kojto 113:f141b2784e32 1293 }
Kojto 113:f141b2784e32 1294
Kojto 113:f141b2784e32 1295 /** \brief Disable MMU
Kojto 113:f141b2784e32 1296
Kojto 113:f141b2784e32 1297 Disable MMU
Kojto 113:f141b2784e32 1298 */
Kojto 113:f141b2784e32 1299 __attribute__( ( always_inline ) ) __STATIC_INLINE void __disable_mmu(void) {
Kojto 113:f141b2784e32 1300 // Clear M bit 0 to disable the MMU
Kojto 113:f141b2784e32 1301 __set_SCTLR( __get_SCTLR() & ~1);
Kojto 113:f141b2784e32 1302 __ISB();
Kojto 113:f141b2784e32 1303 }
Kojto 113:f141b2784e32 1304
Kojto 113:f141b2784e32 1305 /******************************** TLB maintenance operations ************************************************/
Kojto 113:f141b2784e32 1306 /** \brief Invalidate the whole tlb
Kojto 113:f141b2784e32 1307
Kojto 113:f141b2784e32 1308 TLBIALL. Invalidate the whole tlb
Kojto 113:f141b2784e32 1309 */
Kojto 113:f141b2784e32 1310
Kojto 113:f141b2784e32 1311 __attribute__( ( always_inline ) ) __STATIC_INLINE void __ca9u_inv_tlb_all(void) {
Kojto 113:f141b2784e32 1312 #if 1
Kojto 113:f141b2784e32 1313 __ASM volatile ("mcr p15, 0, %0, c8, c7, 0" : : "r" (0));
Kojto 113:f141b2784e32 1314 #else
Kojto 113:f141b2784e32 1315 register uint32_t __TLBIALL __ASM("cp15:0:c8:c7:0");
Kojto 113:f141b2784e32 1316 __TLBIALL = 0;
Kojto 113:f141b2784e32 1317 #endif
Kojto 113:f141b2784e32 1318 __DSB();
Kojto 113:f141b2784e32 1319 __ISB();
Kojto 113:f141b2784e32 1320 }
Kojto 113:f141b2784e32 1321
Kojto 113:f141b2784e32 1322 /******************************** BTB maintenance operations ************************************************/
Kojto 113:f141b2784e32 1323 /** \brief Invalidate entire branch predictor array
Kojto 113:f141b2784e32 1324
Kojto 113:f141b2784e32 1325 BPIALL. Branch Predictor Invalidate All.
Kojto 113:f141b2784e32 1326 */
Kojto 113:f141b2784e32 1327
Kojto 113:f141b2784e32 1328 __attribute__( ( always_inline ) ) __STATIC_INLINE void __v7_inv_btac(void) {
Kojto 113:f141b2784e32 1329 #if 1
Kojto 113:f141b2784e32 1330 __ASM volatile ("mcr p15, 0, %0, c7, c5, 6" : : "r" (0));
Kojto 113:f141b2784e32 1331 #else
Kojto 113:f141b2784e32 1332 register uint32_t __BPIALL __ASM("cp15:0:c7:c5:6");
Kojto 113:f141b2784e32 1333 __BPIALL = 0;
Kojto 113:f141b2784e32 1334 #endif
Kojto 113:f141b2784e32 1335 __DSB(); //ensure completion of the invalidation
Kojto 113:f141b2784e32 1336 __ISB(); //ensure instruction fetch path sees new state
Kojto 113:f141b2784e32 1337 }
Kojto 113:f141b2784e32 1338
Kojto 113:f141b2784e32 1339
Kojto 113:f141b2784e32 1340 /******************************** L1 cache operations ******************************************************/
Kojto 113:f141b2784e32 1341
Kojto 113:f141b2784e32 1342 /** \brief Invalidate the whole I$
Kojto 113:f141b2784e32 1343
Kojto 113:f141b2784e32 1344 ICIALLU. Instruction Cache Invalidate All to PoU
Kojto 113:f141b2784e32 1345 */
Kojto 113:f141b2784e32 1346 __attribute__( ( always_inline ) ) __STATIC_INLINE void __v7_inv_icache_all(void) {
Kojto 113:f141b2784e32 1347 #if 1
Kojto 113:f141b2784e32 1348 __ASM volatile ("mcr p15, 0, %0, c7, c5, 0" : : "r" (0));
Kojto 113:f141b2784e32 1349 #else
Kojto 113:f141b2784e32 1350 register uint32_t __ICIALLU __ASM("cp15:0:c7:c5:0");
Kojto 113:f141b2784e32 1351 __ICIALLU = 0;
Kojto 113:f141b2784e32 1352 #endif
Kojto 113:f141b2784e32 1353 __DSB(); //ensure completion of the invalidation
Kojto 113:f141b2784e32 1354 __ISB(); //ensure instruction fetch path sees new I cache state
Kojto 113:f141b2784e32 1355 }
Kojto 113:f141b2784e32 1356
Kojto 113:f141b2784e32 1357 /** \brief Clean D$ by MVA
Kojto 113:f141b2784e32 1358
Kojto 113:f141b2784e32 1359 DCCMVAC. Data cache clean by MVA to PoC
Kojto 113:f141b2784e32 1360 */
Kojto 113:f141b2784e32 1361 __attribute__( ( always_inline ) ) __STATIC_INLINE void __v7_clean_dcache_mva(void *va) {
Kojto 113:f141b2784e32 1362 #if 1
Kojto 113:f141b2784e32 1363 __ASM volatile ("mcr p15, 0, %0, c7, c10, 1" : : "r" ((uint32_t)va));
Kojto 113:f141b2784e32 1364 #else
Kojto 113:f141b2784e32 1365 register uint32_t __DCCMVAC __ASM("cp15:0:c7:c10:1");
Kojto 113:f141b2784e32 1366 __DCCMVAC = (uint32_t)va;
Kojto 113:f141b2784e32 1367 #endif
Kojto 113:f141b2784e32 1368 __DMB(); //ensure the ordering of data cache maintenance operations and their effects
Kojto 113:f141b2784e32 1369 }
Kojto 113:f141b2784e32 1370
Kojto 113:f141b2784e32 1371 /** \brief Invalidate D$ by MVA
Kojto 113:f141b2784e32 1372
Kojto 113:f141b2784e32 1373 DCIMVAC. Data cache invalidate by MVA to PoC
Kojto 113:f141b2784e32 1374 */
Kojto 113:f141b2784e32 1375 __attribute__( ( always_inline ) ) __STATIC_INLINE void __v7_inv_dcache_mva(void *va) {
Kojto 113:f141b2784e32 1376 #if 1
Kojto 113:f141b2784e32 1377 __ASM volatile ("mcr p15, 0, %0, c7, c6, 1" : : "r" ((uint32_t)va));
Kojto 113:f141b2784e32 1378 #else
Kojto 113:f141b2784e32 1379 register uint32_t __DCIMVAC __ASM("cp15:0:c7:c6:1");
Kojto 113:f141b2784e32 1380 __DCIMVAC = (uint32_t)va;
Kojto 113:f141b2784e32 1381 #endif
Kojto 113:f141b2784e32 1382 __DMB(); //ensure the ordering of data cache maintenance operations and their effects
Kojto 113:f141b2784e32 1383 }
Kojto 113:f141b2784e32 1384
Kojto 113:f141b2784e32 1385 /** \brief Clean and Invalidate D$ by MVA
Kojto 113:f141b2784e32 1386
Kojto 113:f141b2784e32 1387 DCCIMVAC. Data cache clean and invalidate by MVA to PoC
Kojto 113:f141b2784e32 1388 */
Kojto 113:f141b2784e32 1389 __attribute__( ( always_inline ) ) __STATIC_INLINE void __v7_clean_inv_dcache_mva(void *va) {
Kojto 113:f141b2784e32 1390 #if 1
Kojto 113:f141b2784e32 1391 __ASM volatile ("mcr p15, 0, %0, c7, c14, 1" : : "r" ((uint32_t)va));
Kojto 113:f141b2784e32 1392 #else
Kojto 113:f141b2784e32 1393 register uint32_t __DCCIMVAC __ASM("cp15:0:c7:c14:1");
Kojto 113:f141b2784e32 1394 __DCCIMVAC = (uint32_t)va;
Kojto 113:f141b2784e32 1395 #endif
Kojto 113:f141b2784e32 1396 __DMB(); //ensure the ordering of data cache maintenance operations and their effects
Kojto 113:f141b2784e32 1397 }
Kojto 113:f141b2784e32 1398
Kojto 113:f141b2784e32 1399 /** \brief Clean and Invalidate the entire data or unified cache
Kojto 113:f141b2784e32 1400
Kojto 113:f141b2784e32 1401 Generic mechanism for cleaning/invalidating the entire data or unified cache to the point of coherency.
Kojto 113:f141b2784e32 1402 */
Kojto 113:f141b2784e32 1403 extern void __v7_all_cache(uint32_t op);
Kojto 113:f141b2784e32 1404
Kojto 113:f141b2784e32 1405
Kojto 113:f141b2784e32 1406 /** \brief Invalidate the whole D$
Kojto 113:f141b2784e32 1407
Kojto 113:f141b2784e32 1408 DCISW. Invalidate by Set/Way
Kojto 113:f141b2784e32 1409 */
Kojto 113:f141b2784e32 1410
Kojto 113:f141b2784e32 1411 __attribute__( ( always_inline ) ) __STATIC_INLINE void __v7_inv_dcache_all(void) {
Kojto 113:f141b2784e32 1412 __v7_all_cache(0);
Kojto 113:f141b2784e32 1413 }
Kojto 113:f141b2784e32 1414
Kojto 113:f141b2784e32 1415 /** \brief Clean the whole D$
Kojto 113:f141b2784e32 1416
Kojto 113:f141b2784e32 1417 DCCSW. Clean by Set/Way
Kojto 113:f141b2784e32 1418 */
Kojto 113:f141b2784e32 1419
Kojto 113:f141b2784e32 1420 __attribute__( ( always_inline ) ) __STATIC_INLINE void __v7_clean_dcache_all(void) {
Kojto 113:f141b2784e32 1421 __v7_all_cache(1);
Kojto 113:f141b2784e32 1422 }
Kojto 113:f141b2784e32 1423
Kojto 113:f141b2784e32 1424 /** \brief Clean and invalidate the whole D$
Kojto 113:f141b2784e32 1425
Kojto 113:f141b2784e32 1426 DCCISW. Clean and Invalidate by Set/Way
Kojto 113:f141b2784e32 1427 */
Kojto 113:f141b2784e32 1428
Kojto 113:f141b2784e32 1429 __attribute__( ( always_inline ) ) __STATIC_INLINE void __v7_clean_inv_dcache_all(void) {
Kojto 113:f141b2784e32 1430 __v7_all_cache(2);
Kojto 113:f141b2784e32 1431 }
Kojto 113:f141b2784e32 1432
Kojto 113:f141b2784e32 1433 #include "core_ca_mmu.h"
Kojto 113:f141b2784e32 1434
Kojto 113:f141b2784e32 1435 #elif (defined (__TASKING__)) /*--------------- TASKING Compiler -----------------*/
Kojto 113:f141b2784e32 1436
Kojto 113:f141b2784e32 1437 #error TASKING Compiler support not implemented for Cortex-A
Kojto 113:f141b2784e32 1438
Kojto 113:f141b2784e32 1439 #endif
Kojto 113:f141b2784e32 1440
Kojto 113:f141b2784e32 1441 /*@} end of CMSIS_Core_RegAccFunctions */
Kojto 113:f141b2784e32 1442
Kojto 113:f141b2784e32 1443
Kojto 113:f141b2784e32 1444 #endif /* __CORE_CAFUNC_H__ */